散50分，只为请教一个问题，，

发表于 2010-5-30 11:58

本帖最后由 ZHOUNACHU 于 2011-5-24 10:12 编辑

最近想确定下来专心学一种语言（Verilog or VHDL），只是不知如何选择，在这里我特地散分，以求过来人的观点，谢谢！

ZHOUNACHU · 发表于 2010-5-30 14:37

我公司是用VHDL，但社会上用Verilog的多。主要是如果你的设计要转化为IC，你还得通过Verilog 语言，从这一点看。Verilog的更流行一些，如果只是做算法的话，VHDL好一些。希望你有自己的决定。记得一点是，不要二种语言一起学，否则你会一直处在比较当中。

发表于 2010-5-30 15:35

学Verilog 吧，用的人多，也容易学。

ZHOUNACHU · 发表于 2010-5-30 15:57

我要10分!!!
你如果对硬件电路比较熟悉,建议你学vhdl;
如果你对c语言(上位机)比较熟悉建议你Vlog.

ZHOUNACHU · 发表于 2010-5-30 16:10

呵呵，先入为主很正常。

既然你都已经学了VHDL了，那就一直用它用到很熟、很精再去学其他的，不然两者很容易混淆的。
VHDL偏向于硬件逻辑，Verilog更偏向于算法些，一般应用的话有数字电路基础的话学VHDL语言确实容易些，毕竟很多时候都是在搭硬件逻辑。

而复杂的IP核则用Verilog 更好描叙一些，就好比汇编与C，只是语法差别没有那么大而已。

发表于 2010-5-30 20:42

我粗步学过VHDL和Verilog ，可能我对硬件和汇编比对C语言更内行些，感觉VHDL通俗简洁些.

发表于 2010-5-30 22:24

而接触过，所以不能给楼主建议

发表于 2010-5-30 23:03

建议学Verilog

发表于 2010-5-30 23:06

建议学Verilog，Verilog用的人多，容易学。
以前都说Verilog在系统描述方面不如VHDL，但现在不同了，Verilog-2005在在系统描述方面甚至比VHDL有过之而无不及。不过现在在国内能见到的顶多是Verilog-2001

发表于 2010-5-31 07:07

本帖最后由 Mindor 于 2010-5-31 07:08 编辑

过了这村儿没这店儿了。。。哈哈
我也觉得先把精力放在一个侧重点上，先把你有点熟悉的语言用熟练了。。。

发表于 2010-5-31 08:26

建议楼主学Verilog，人多力量大吗！！！:)

发表于 2010-5-31 08:44

Verilog的关键字短，嘿嘿
这是一个学Verilog的好处吧，呵呵

ZHOUNACHU · 发表于 2010-5-31 08:46

我是学的verilog  感觉还是verilog好学  但是有时需要看别人用vhdl写的程序
所以我感觉还是精通verilog 用来写程序    再熟悉一下vhdl，能看懂程序就好

ps：我不要10分  给5分行不？

发表于 2010-5-31 09:58

建议学Verilog

发表于 2010-5-31 10:25

强烈建议楼主学verilog，因为verilog和C很相似，以后如果去搞C开发业很方便。VHDL相当汇编，很难记。VHDL只在高校学过，现在基本用verilog

发表于 2010-5-31 11:40

1、看自己的兴趣在哪方面
2、社会上verilog用的较多，可选择学习
3、专心研究一项，一通百通

发表于 2010-5-31 11:53

感觉VHDL比较难

发表于 2010-5-31 12:23

我进来时顶7楼的，不管对不对，只顶这个风格。

ZHOUNACHU · 发表于 2010-5-31 12:50

其实学那个都无所谓，存在就是道理。这个语言能够发展到今天，必然都有它的优秀地方。用心去学习一门就得啊。

发表于 2010-5-31 16:03

推荐Verilog，大部分国内公司都在往这种语言普及

散50分，只为请教一个问题，，

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