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关于verilog中 task编写的问题

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jakfens|  楼主 | 2011-8-11 11:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
verilog, 编写, 阻塞, 阻塞赋值, se
弱弱地问一下：在verilog里面，在编写task时，可以使用非阻塞赋值么？
听说task很难综合 那用ISE能综合出来么？

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沙发
lxc806705| | 2011-8-11 11:29 | 只看该作者
task好像都是综合成组合逻辑的---我也不确定--

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sxhhhjicbb + 1
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wgej1987| | 2011-8-11 14:53 | 只看该作者
我状态机的应用用的task，我把task当封装用的，这样的用法能综合啊，不过我也是新手

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地板
zwy65182899| | 2011-8-16 10:20 | 只看该作者
期待，大虾发话

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