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请教：max plus II 仿真错误：can't find design file
仿真 ，CAN ，Design ，ST ，logic
EDA 技术 rb1549 2010-5-20 0 4136 rb1549 2010-5-20 21:59
n.5分频的VHDL实现
VHDL ，时钟 ，ST ，logic ，ic
FPGA论坛 yun888 2010-8-20 0 2414 yun888 2010-8-20 10:05
VHDL秒表计时器设计程序
VHDL ，ST ，开关 ，logic ，ic
FPGA论坛 yun888 2010-8-20 0 3515 yun888 2010-8-20 10:06
VHDL实现多路彩灯控制器
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FPGA论坛 nan678 2010-8-20 0 3120 nan678 2010-8-20 10:11
半整数分频的VHDL程序
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FPGA论坛 jie4567 2010-8-20 0 2398 jie4567 2010-8-20 10:16
Spartan-6 FPGA Configurable Logic Block attachment
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FPGA论坛 sherry88 2010-8-25 0 2657 sherry88 2010-8-25 10:09
[知识] 在一个进程内不能同时使用 wait语句和 cp ‘event语句
AI ，ev ，进程 ，ST ，logic
FPGA论坛 jie4567 2010-8-27 0 2251 jie4567 2010-8-27 09:54
[知识] 定义SIGNAL未初始化的状态
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FPGA论坛 jie4567 2010-8-27 0 2392 jie4567 2010-8-27 09:55
【求助】ps2键盘实验
PS2键盘 ，ST ，ic ，logic ，TI
FPGA论坛 lixin6886518 2010-10-4 0 2510 lixin6886518 2010-10-4 10:40
设计一简单同步fifo，但找不到问题在哪
同步FIFO ，ST ，ic ，logic ，se
FPGA论坛 wxfxwk1986 2010-11-26 0 2310 wxfxwk1986 2010-11-26 16:36
MDE信令转换设备成功应用于湖北某移动呼叫中心
移动 ，logic ，板卡 ，通信 ，Dialog
供需广告 medou 2011-1-13 0 1980 medou 2011-1-13 10:26
请各位帮忙指点
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模拟技术论坛 jiaxin1 2011-2-11 0 3616 jiaxin1 2011-2-11 14:25
在PADS2007中如何画Lines?
pads2007 ，LINES ，ADSL ，library ，logic
EDA 技术 z490380831 2011-7-31 0 1927 z490380831 2011-7-31 20:40
PADS Logic最底下一行为什么不显示栅格标志？
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PCB技术 zhoubojay 2011-10-15 0 3834 zhoubojay 2011-10-15 20:24
新人请教关于T触发器的问题~~~
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FPGA论坛 mhanchen 2011-12-26 0 2151 mhanchen 2011-12-26 13:12
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电子技术交流论坛 mhanchen 2011-12-26 0 1763 mhanchen 2011-12-26 21:40
语句请教
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FPGA论坛 hlhfootbal 2012-1-5 0 1623 hlhfootbal 2012-1-5 23:03
LogicLock逻辑锁定工具使用技巧
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ZLG FVJFIFE 2012-1-18 0 1979 FVJFIFE 2012-1-18 12:36
七值逻辑比二值逻辑更费资源吗？
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最新的版本saleae logic 1.1.15逻辑分析仪
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供需广告 瑞佳电子 2012-4-6 0 5019 瑞佳电子 2012-4-6 12:20
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