我的IC打工历程
2011-12-16 19:04
- 创业|外包|承接
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嵌入式。。。广告:D
热烈庆祝赛灵思发布世界最大FPGA
2012-2-1 15:24
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确实很牛啊。。。
首批"X-MEN荣誉勋章"获得者荣耀登场
2012-2-28 11:47
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恭喜各位！
啥时候按也能成X-Men呢？要努力了。。。
读得懂verilog，但是看不懂书上综合的RTL视图，肿么办？
2011-11-22 21:59
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补补数电的知识吧
菜鸟求助关于FPGA时延问题
2012-1-1 12:47
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50M晶振计数得到0.5秒的延时？
NIOS 找不到库文件，谁知道怎么回事啊
2011-12-5 15:46
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不知道。。。
NIOS还是不要用的好
FPGA时序收敛设计技巧
2011-12-26 23:32
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逻辑综合、时序收敛、时序约束、编译、实现。。。
似乎作者对这些感念有点模糊，所以看完了感觉写的不够深 ...
热烈庆祝“明空”晋升为三级X-man
2012-1-12 18:23
- FPGA论坛
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呵呵，恭喜恭喜！
关于OFFSET约束
2012-2-18 19:45
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OFFSET IN 其实就是告诉FPGA外来的Data与Clock之间的时序关系，包括数据在相对于时钟在什么时刻有效，并能 ...
请教版主们VHDL 的有符号运算
2012-1-6 15:41
- FPGA论坛
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http://forums.xilinx.com/xlnx/board/crawl_message?board.id=DSP&message.id=538
【Xilinx 北京招聘】 Sr IO Specialist FAE
2012-2-3 21:57
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高层次综合
从一山不容二虎到长尾理论
2012-2-23 14:02
- 创业|外包|承接
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- 2875
你以为你所谓的GCD就那么轻松吗？随便找个厅局级的干部，仔细聊聊，绝对比你想象的要强大得多。
能管理这 ...
金钱和地位就是身上的包袱，担子重了，自然没法那么灵活。。。
时序仿真不正确怎么办？
2012-3-12 17:21
- FPGA论坛
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15# GoldSunMonkey
还得多向版上的高手们多学习啊:)
1. 哪里不正确?输出的数据?
2. 看看布局布线后Fmax能跑多少?
3. 数据的截断是否符合你的精度要求? ...
这样的时序报告合格吗
2012-3-29 20:37
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Setup有时序不满足的路径,先解决那个吧
时序报告最好先看Summary
基于FPGA的电阻抗成像系统激励信号源
2012-4-1 18:32
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- 2557
转载**请注名出处,这是对原作者的尊重,也是对自己负责
时序报告中的最高频率
2012-4-4 22:21
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- 2480
谁高谁低不重要,只需知道布局布线后的时序分析才是准确的就行了
求解ISE运行过程
2012-4-29 10:44
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- 3633
这个说的比较靠谱。
最活跃FPGA论坛推荐
2012-5-23 20:55
- FPGA论坛
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- 4857
嗯，还是觉得曾经的EDACN是最好的，确实是可惜了。。。
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