Xilinx RapidIO IP核不能生成bit文件求大神指教
2013-12-10 19:48
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您好，请问rapidio搞定了吗？最近我也刚开始看这个，以后有问题能向你多请教下吗？哈哈 3# moyichen123 ...
spartan6的serial rapidIO 的IP有人用过米有？
2012-7-16 13:39
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您好，我最近也在做DSP与FPGA之间的rapidio接口，哈哈，以后多多向您请教啊 3# lelee007 ...
赛灵思rapidIO IP核自带的实例问题请教
2013-9-4 20:13
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请问搞定了吗？兄弟，最近我也刚开始用，也是605的开发板 91# zy7598865
请问你是怎么在官网申请的啊，请指教，哈哈，第一次申请IP核 81# zy7598865
以Spartan3E开讲Xilinx FPGA 内部结构（10.5更新，位于88楼）
2015-7-30 11:35
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话说是直接点击评分就算给分了吗？猴哥 2# GoldSunMonkey
lvds时钟输出的问题!!!
2012-2-7 17:27
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可以人工再加个bufg对吗？猴哥是这个意思吗？一般DCM的输出不是加个BUFG吗，然后再加差分驱动 20# GoldSunM ...
chipscope使用问题
2011-12-12 14:14
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可以的，如果找不到，你可以引到顶层几个信号与下输出 7# 674467523
为什么注册不了，大家帮忙看看
2011-12-29 23:45
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2# GoldSunMonkey 上面说的是免费的，主要是不能注册啊
如何使用xilinx的MIG
2012-1-1 21:41
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我用的是ML605，应该都一样，官网一般都有demo程序，那个是别人设计好的，如果你自己生成的话，必须修改管 ...
整个BANK的IO都不用，对应的VCCO是不是可以不加滤波电容
2011-12-1 20:51
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猴哥就是中国FPGA的希望啊
GSM给您解释解释XILINX XST综合的选项的含义（完成）
2013-3-28 18:13
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顶，多谢GSM，哈哈
多的不说,一句话: 感谢GSM猴哥
2011-11-23 15:32
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哎，我的名字真是太悲剧了，当时起什么名字都通不过，最后自己生气了，起个受不了你倒通过啦，哈哈 ...
很是感谢
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