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verilogHDL菜鸟的初问
VerilogHDL ，edge ，POS ，se ，os
EDA 技术 52mcu 2008-1-14 2 2331 xjg121 2008-1-25 22:25
一个比较奇怪的问题，关于下载
altera ，TE ，verilo ，编译 ，VerilogHDL
EDA 技术 shouzhou 2007-11-10 4 2045 vongy 2007-11-12 19:17
veriloghdl里 位数不同的两个变量怎么赋值 啊
HDL ，verilog ，VerilogHDL ，verilo ，hd
EDA 技术 _horse 2007-9-19 2 4394 _horse 2007-9-19 21:24
读不懂 veriloghdl，郁闷
VerilogHDL ，se ，default ，hb ，rc
EDA 技术 hawktca 2007-4-26 0 2260 hawktca 2007-4-26 15:46
读不懂 veriloghdl，郁闷
VerilogHDL ，se ，default ，hb ，rc
EDA 技术 hawktca 2007-4-26 0 2304 hawktca 2007-4-26 15:46
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