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geseedgemoduleOutput
EDA 技术 ljl86400 2011-6-1 5 2621 ljl86400 2011-6-2 12:38
verilog的一个问题
veriloggeedgeSTos
FPGA论坛 dobypig 2012-5-15 6 2179 可木 2012-5-18 00:02
关于信号延迟问题 attach_img
信号延迟segeedgePOS
FPGA论坛 huangjianhuang 2012-6-28 6 2794 GoldSunMonkey 2012-7-9 22:12
【求助】这个程序怎么改?? attach_img
geSTedgeANdistance
FPGA论坛 夏沫沫1112 2012-7-11 6 2139 greenapl1985 2012-7-16 22:31
verilog语言中always语句使用 FPGA论坛 robbins37 2012-10-10 6 4025 GoldSunMonkey 2012-10-11 18:10
该怎么弄?
定时timerTIedgeos
FPGA论坛 hotsauceisme 2013-1-4 5 2116 shiyinjita 2013-1-8 23:44
如何同时使用上升沿和下降沿!?
geedgePOSseos
FPGA论坛 ywert000 2013-1-28 5 2845 薇儿安蓝 2013-1-31 10:31
这是一个边沿检测,但是我看不懂,我觉得检测不出啦啊,有没有大师可以给讲解一下
geedgeSTRSPOS
FPGA论坛 yushiqian2012 2013-2-24 6 1991 diego01 2013-2-26 15:55
PWM延时,FPGA里如何实现?我写的程序为什么出现这样的问题 attach_img
PWMFPGAgeedgePOS
FPGA论坛 lae129 2013-6-9 5 1706 lae129 2013-6-9 13:37
求助这段verilog点灯程序咋理解
verilogLEDedgenpuos
FPGA论坛 flyhouse112 2013-8-26 5 3023 flyhouse112 2013-8-29 10:02
fpga有一个信号不受控制自动拉低
FPGA信号控制geedge
EDA 技术 502593045 2013-11-18 5 1623 zhaojingzb 2013-11-29 12:02
if(1)有效不行,if(!0)则可以,望解答
TEniedgePOSse
FPGA论坛 tiantianlianxi 2013-11-20 5 1505 tiantianlianxi 2013-11-21 19:49
为什么不能赋值 attach_img
LEDgeedgeRSST
FPGA论坛 william228 2013-12-25 5 1521 william228 2013-12-28 17:08
求助,问一个关于消抖电路的问题 attach_img
电路geRSSTedge
FPGA论坛 nm2012 2014-4-6 5 1441 GoldSunMonkey 2014-4-8 08:49
语法报错!always敏感信号对其内部if语句的影响?
信号geedgeLEDST
FPGA论坛 a2582006460 2014-6-10 5 2003 a2582006460 2014-6-24 17:09
FPGA内部产生复位信号可以吗
FPGA信号edgePOSse
FPGA论坛 mryw 2015-3-26 5 2248 wolfskin 2015-4-15 23:39
错误怎么找啊?
geSTRStcedge
FPGA论坛 魔人布欧 2016-3-8 5 2197 happybbs163 2016-3-22 20:21
看门狗复位 新唐MCU gejigeji521 2019-6-30 6 1015 xinxianshi 2019-7-23 21:56
003的配置字如何在程序里修改
TEnuvotonrightedgese
新唐MCU 幸福小强 2019-11-24 6 677 dongnanxibei 2019-11-27 07:10
配置有问题吗?
geTEinterinterruptedge
中颖MCU gongche 2021-2-5 5 2648 flycamelaaa 2024-9-27 10:53
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