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verilog高手看看我的reg变量判断为啥第二种写法编译报错呢？ attach_img
verilog ，编译 ，ge ，RS ，ST
FPGA论坛 (⊙o⊙)你 2019-9-10 18 2019 (⊙o⊙)你 2021-5-10 15:20
Verilog HDL的基本语法 attachment
HDL ，verilog ，模型 ，电路 ，VerilogHDL
FPGA论坛 mdy郭柏荣 2019-9-6 2 943 mdy郭柏荣 2019-10-18 15:31
采用Verilog HDL语言编写的多功能数字钟 attach_img
verilog ，编写 ，hdl语言 ，多功能数字钟 ，Pay
FPGA论坛 GLL92 2019-8-31 1 1024 zhangmangui 2019-8-31 23:43
自动售货机 Verilog 语言 状态机 FPGA 源代码 论文完整程序及... attach_img
FPGA ，verilog ，源代码 ，状态机 ，自动售货机
FPGA论坛 zszcn 2019-8-30 0 12509 无须终有iiiiii 2024-9-26 11:23
8位verilog加法器 attach_img
加法器 ，verilog ，信号 ，ni ，FPGA
FPGA论坛 mdy郭柏荣 2019-8-6 0 810 mdy郭柏荣 2019-8-6 14:47
串口发送
串口发送 ，verilog ，源码 ，频率计 ，verilo
FPGA论坛 fgc35159 2019-7-29 4 1062 zhangmangui 2019-7-31 20:43
FPGA是什么？应用于哪方面？
FPGA ，电路 ，verilo ，verilog ，VHDL
FPGA论坛 mdy郭柏荣 2019-7-25 1 842 mdy郭柏荣 2019-7-25 16:29
第一个verilog的LED程序，仿真成功 attach_img
verilog ，仿真 ，LED程序 ，se ，TPU
FPGA论坛 springvirus 2019-7-2 7 3038 fzwwj95 2020-5-15 18:09
verilog编译错误
verilog ，编译 ，HDL ，ce ，DM
新手园地 fgc35159 2019-6-19 2 1831 ta1ent 2019-6-24 15:01
大神们，请问有关于超声全聚焦算法的Verilog的程序吗？我想参考一下。
verilog ，超声 ，FPGA ，PGA ，算法研究
FPGA论坛 qqqpppzzz 2019-5-30 0 963 qqqpppzzz 2019-5-30 09:48
请问这是verilog的什么语法 attach_img
verilog ，AC ，Output ，TPU ，ce
FPGA论坛 ahhhhh 2019-5-16 4 1009 thbdbdfbdfbd 2019-6-15 22:13
如何编程设计三级流水线，计算样本方差 attach_img
编程 ，AC ，C语言 ，verilog ，编写
电子技术交流论坛 TDJC 2019-5-6 0 700 TDJC 2019-5-6 17:56
verilog 报错提示求助
verilog ，TE ，ST ，IO ，se
电子技术交流论坛 自由电子ERIC 2019-5-3 0 522 自由电子ERIC 2019-5-3 15:40
FPGA学习及设计中的注意事项
FPGA ，硬件 ，工程师 ，仿真 ，verilog
FPGA论坛 24875314 2019-4-28 1 918 zhangmangui 2019-4-28 22:30
有偿请教verilog 就是一些顶层模块例化问题，我不会连接
verilog ，NEC ，TE ，ST ，IO
FPGA论坛 老吴EST 2019-4-27 0 928 老吴EST 2019-4-27 10:50
LTE下行同步小区搜索的FPGA实现
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FPGA实现无线干扰代码
代码 ，无线 ，FPGA实现 ，verilog ，verilo
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verilog实现 floor, round 四舍五入 和 saturation 操作
ratio ，verilog ，round ，TE ，AD
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找verilog 编写人员 北京海淀
verilog ，编写 ，verilo
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AD ，verilog ，时序 ，时序图 ，verilog程序
FPGA论坛 lanzhi112 2018-12-21 7 5757 城南123 2021-7-6 21:59
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