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FPGA学习及设计中的注意事项
FPGA ，硬件 ，工程师 ，仿真 ，verilog
FPGA论坛 24875314 2019-4-28 1 884 zhangmangui 2019-4-28 22:30
有偿请教verilog 就是一些顶层模块例化问题，我不会连接
verilog ，NEC ，TE ，ST ，IO
FPGA论坛 老吴EST 2019-4-27 0 898 老吴EST 2019-4-27 10:50
LTE下行同步小区搜索的FPGA实现
FPGA实现 ，LTE ，verilog ，代码 ，verilo
创业|外包|承接 Han0zgdzw 2019-3-1 0 726 Han0zgdzw 2019-3-1 19:34
FPGA实现无线干扰代码
代码 ，无线 ，FPGA实现 ，verilog ，verilo
创业|外包|承接 飞鹰嵌入式 2019-2-25 0 561 飞鹰嵌入式 2019-2-25 14:37
verilog实现 floor, round 四舍五入 和 saturation 操作
ratio ，verilog ，round ，TE ，AD
FPGA论坛 yg99992 2019-2-19 2 15094 myl000 2024-5-19 14:39
找verilog 编写人员 北京海淀
verilog ，编写 ，verilo
创业|外包|承接 兼职设计 2019-2-9 0 729 兼职设计 2019-2-9 14:39
AD7854 attachment
AD ，verilog ，时序 ，时序图 ，verilog程序
FPGA论坛 lanzhi112 2018-12-21 7 5597 城南123 2021-7-6 21:59
verilog用$fopen打不开txt文件
verilog ，pen ，RS ，代码 ，TE
FPGA论坛 nb533 2018-12-9 0 1620 nb533 2018-12-9 20:46
基于Verilog HDL的FIR数字滤波器设计与仿真 attachment
HDL ，verilog ，FIR数字滤波器 ，仿真 ，数字滤波器设计
德州仪器模拟论坛 Violin11 2018-12-5 1 686 Violin11 2018-12-5 16:26
求电子书《Programming FPGAs_ Getting Started with Verilog》 attachment
getting ，programming ，started ，verilog ，电子书
电子技术交流论坛 azsxdcfv 2018-11-27 3 783 friedrichwjs 2019-2-18 08:45
Intel FPGA + 入门了解 attachment
FPGA ，intel ，电路 ，编程 ，verilog
艾睿技术服务社区 yinwuqing110 2018-11-18 3 1732 nbnhnjnm 2019-1-28 14:23
intel FPGA+浅谈 attachment
FPGA ，intel ，AC ，编程 ，verilog
艾睿技术服务社区 kelly1989 2018-11-15 5 2560 zazszxzx 2019-1-28 14:43
明德扬FPGA连载课程第一阶段第三章VERILOG（2）
verilog ，FPGA ，电平 ，信号 ，芯片
FPGA论坛 guyu_1 2018-11-6 0 751 guyu_1 2018-11-6 09:20
明德扬FPGA连载课程第一阶段第三章VERILOG（1）
verilog ，FPGA ，仿真 ，电路 ，HDL
电子技术交流论坛 guyu_1 2018-11-5 0 691 guyu_1 2018-11-5 20:23
对分频器ip核的不理解 attach_img
ip核 ，分频器 ，verilog ，奇数分频 ，verilo
FPGA论坛 呱呱年 2018-10-21 4 2012 forrest11 2018-10-29 12:50
verilog请教 attach_img
verilog ，verilo ，TE
新手园地 欢乐的小僵尸 2018-10-17 2 566 零三翟邢止胃 2019-3-25 09:03
明德扬至简设计法--verilog的综合器和仿真器 attach_img
仿真器 ，verilog ，代码 ，电路 ，编写
FPGA论坛 明德扬fpga 2018-10-8 0 767 明德扬fpga 2018-10-8 15:54
用Verilog或VHDL写一段代码,实现消除一个glitch？
verilog ，VHDL ，代码 ，tc
新手园地 一片混沌 2018-9-11 0 203 一片混沌 2018-9-11 12:02
如何用VERILOG或VHDL写一段代码，实现10进制计数器？
verilog ，VHDL ，代码 ，进制计数器
新手园地 道子 2018-9-11 0 317 道子 2018-9-11 10:14
怎么区分哪些buffer/inverter是CTS插入的，哪些是原Verilog网表里的？
buffer ，INVERTER ，verilog ，verilo ，TE
新手园地 第十代火影 2018-9-10 0 340 第十代火影 2018-9-10 14:12
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