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如用用Verilog HDL 实现CPLD与DPS之间的数据传递?
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verilog中复位为何用下降沿 FPGA论坛 magic_yuan 2013-4-5 6 5700 jahnson066 2013-4-6 13:40
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关于Verilog的两个小疑问 EDA 技术 brace1108 2013-3-30 3 1972 jakfens 2013-4-2 09:13
Verilog问题
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万利电子 yybj 2013-3-26 3 2779 xsgy123 2013-3-26 20:03
分享:任意奇数分频(50%占空比) verilog 代码 attach_img FPGA论坛 cuianbin 2013-3-22 17 3576 GoldSunMonkey 2013-7-12 19:49
求教关于VHDL和Verilog HDL的问题 FPGA论坛 pangning7085 2013-3-21 14 2439 GoldSunMonkey 2013-3-27 23:18
新人请教verilog HDL的延时问题。 FPGA论坛 pangning7085 2013-3-21 17 2829 GoldSunMonkey 2013-3-24 21:52
求OFDM代码
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分频器简单问题 FPGA论坛 magic_yuan 2013-3-14 4 1634 magic_yuan 2013-3-15 09:32
谁有可设置任意波特率的Uart程序(verilog的)? attach_img FPGA论坛 jlgcumt 2013-3-10 21 5855 click_lijie 2016-12-3 19:02
初学verilog,感觉遇到逻辑电路力不从心! attach_img
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FPGA论坛 黑暗小y 2013-3-8 9 1764 黑暗小y 2013-3-9 22:44
为什么我多余定义的信号不报警告呢?
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verilog HDL 与 VHDL的区别 EDA 技术 51xlf 2013-3-6 7 11264 elec921 2013-3-21 08:32
如何用Verilog描述 SPI 16bit数据的传输? attach_img
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verilog HDL 建模基础 FPGA论坛 lection 2013-2-28 8 1498 GoldSunMonkey 2013-3-6 23:13
求教程序! 新手园地 315449340 2013-2-27 4 2498 jlass 2013-3-1 08:23
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