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用verilog写两个数差的绝对值
verilog ，verilo ，AD
FPGA论坛 wrigleymint 2012-11-27 8 3957 hawksabre 2012-11-30 18:39
verilog 不可综合语句
verilog ，TI ，阻塞 ，se ，阻塞赋值
FPGA论坛 dwananqinyan 2012-11-27 11 2598 hawksabre 2012-12-6 21:32
verilog的问题 attachment
verilog ，AD ，module ，ST ，TE
FPGA论坛 fengyiyong 2012-11-26 8 1844 GoldSunMonkey 2012-11-27 18:04
Verilog学习笔记
verilog ，学习笔记 ，module ，Output ，Input
FPGA论坛 xiao6666 2012-11-20 12 2887 qin552011373 2013-3-6 09:40
SD卡利用verilog读取成功 attach_img
SD卡 ，verilog ，时钟 ，控制 ，数据手册
FPGA论坛 gongxiaosong 2012-11-19 11 10676 zhangmangui 2018-7-4 20:25
请问这个时序verilog如何实现 attach_img
verilog ，时序 ，AC ，时钟 ，倍频
FPGA论坛 laihama 2012-11-15 10 2871 xiao6666 2012-11-24 20:27
谁有分频程序？
verilog ，verilo ，PWM ，verilog程序
FPGA论坛 jlgcumt 2012-11-14 11 2291 GoldSunMonkey 2012-11-16 22:03
谁有分频程序？
verilog ，verilo ，PWM ，verilog程序
FPGA论坛 jlgcumt 2012-11-14 5 1759 星星之火红 2012-11-18 16:49
quartus中原理图连线和实例化的差别
Quartus ，UART ，原理图 ，verilog ，verilo
FPGA论坛 gongxiaosong 2012-11-13 2 3212 gongxiaosong 2012-11-14 18:04
Verilog的两个误区 （转载）
verilog ，阻塞 ，阻塞赋值 ，时序 ，se
FPGA论坛 gaochy1126 2012-11-12 3 2061 lzmm 2012-11-13 23:39
共享通过STM32 FSMC 读写FPGA Verilog 例子 attach_img
读写 ，verilog ，STM32 ，FSMC ，FPGA
ST MCU 王紫豪 2012-11-8 673 73416 lfjd05 2016-11-30 12:07
Verilog 保留字
verilog ，TI ，AN ，se ，os
FPGA论坛 星星之火红 2012-11-8 2 1654 GoldSunMonkey 2012-11-8 00:30
Verilog HDL的语言要素
HDL ，verilog ，数据类型 ，编译程序 ，编译
FPGA论坛 星星之火红 2012-11-8 5 2261 星星之火红 2012-11-8 00:10
Verilog HDL三种建模方式
HDL ，verilog ，建模 ，VerilogHDL ，IEEE
FPGA论坛 星星之火红 2012-11-8 7 3946 yghanwuji 2013-10-12 12:18
verilog怎么在不同文件的模块间传递参数？
verilog ，verilo
FPGA论坛 jlgcumt 2012-11-14 14 6231 GoldSunMonkey 2012-11-16 21:56
verilog问题
verilog ，verilo
FPGA论坛 jlgcumt 2012-11-14 2 1536 jlgcumt 2012-11-14 20:07
Verilog非阻塞赋值的仿真/综合问题 -上
阻塞赋值 ，仿真 ，verilog ，编码 ，ST
FPGA论坛 lxAPP 2012-11-20 13 3116 GoldSunMonkey 2013-5-6 21:22
Verilog非阻塞赋值的仿真/综合问题 -下
verilog ，仿真 ，阻塞赋值 ，RS ，ST
FPGA论坛 lxAPP 2012-11-20 5 3207 GoldSunMonkey 2012-11-20 17:28
verilog的问题 attach_img
verilog ，AD ，module ，ST ，TE
DSP 技术 fengyiyong 2012-11-26 0 2172 fengyiyong 2012-11-26 10:54
求助：verilog的ODDR2使用问题
verilog ，DDR ，ST ，TE ，AI
FPGA论坛 wrigleymint 2012-11-27 1 3823 wrigleymint 2012-11-27 17:01
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