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普通I/O输入时钟使用DCM

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楼主
bitshiyan|  楼主 | 2014-12-1 17:35 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
I/O, DCM, 时钟, TE, hz
本帖最后由 bitshiyan 于 2014-12-1 17:36 编辑

如果xilinx V5板子 程序中使用外部输入时钟，clk=36.15MHz，现在需要使用36.15*6=216.9MHz的时钟进行运算，如何生成该时钟？求指导。

ucf文件中已定义
      NET "clk" CLOCK_DEDICATED_ROUTE = FALSE;

如果使用DCM，程序没有反应，warning中多次出现
     Signal xxxx connected to top level port dad has been removed.

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沙发
bitshiyan|  楼主 | 2014-12-8 10:36 | 只看该作者
已解决，方法如下：
sch输入情况下，使用IBUFG连接至PLL输入端，使用PLL代码文件而不是直接使用PLL。仅供参考。

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板凳
xdh1009| | 2014-12-18 14:35 | 只看该作者
楼主 解决问题 还不忘分享  顶@@

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