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verilog中wire和reg的区别
Wire ，verilo ，verilog
Microchip 734774645 2023-12-18 19 710 勇敢的大白菜 2024-3-4 10:36
夏宇闻Verilog学习笔记第二章
verilog ，学习笔记 ，电路 ，模块 ，结构 ，设计
电子技术交流论坛 地瓜patch 2023-12-3 0 263 地瓜patch 2023-12-3 22:11
verilog基础——always、initial
RS ，ST ，verilo ，verilog ，编译
EDA 技术 gaochy1126 2023-11-30 0 2167 gaochy1126 2023-11-30 20:54
Verilog中的运算符
verilo ，verilog ，运算符
EDA 技术 gaochy1126 2023-11-30 0 2156 gaochy1126 2023-11-30 20:52
一文带你了解verilog基础语法
verilo ，verilog
EDA 技术 gaochy1126 2023-11-30 0 2051 gaochy1126 2023-11-30 20:51
Verilog HDL中位运算符、逻辑运算符和缩减运算符的区别
HDL ，hd ，verilo ，verilog ，位运算
EDA 技术 gaochy1126 2023-11-30 0 2129 gaochy1126 2023-11-30 20:50
verilog 中！ 与 ~ 的区别
verilo ，verilog
EDA 技术 gaochy1126 2023-11-30 0 2046 gaochy1126 2023-11-30 20:49
[资料] Verilog设计快速入门秘籍 attachment
verilo ，verilog ，快速入门
技术资源专区 王栋春 2023-11-3 0 2589 王栋春 2023-11-3 22:44
[资料] Verilog的135个经典设计实例 attachment
verilo ，verilog
技术资源专区 王栋春 2023-11-3 1 3218 thynet 2024-1-31 13:16
初学者verilog代码编写上的请教 attach_img
FPGA ，verilog
FPGA论坛 哈哈哈270752 2023-10-25 0 3062 哈哈哈270752 2023-10-25 14:31
Verilog几个这样的写法
verilo ，verilog
EDA 技术 gaochy1126 2023-8-31 1 3357 地瓜patch 2023-8-31 23:01
verilog中符号位的扩展问题
verilo ，verilog
EDA 技术 gaochy1126 2023-8-31 0 3346 gaochy1126 2023-8-31 22:24
verilog，有符号数的运算
verilo ，verilog
EDA 技术 gaochy1126 2023-8-31 0 3311 gaochy1126 2023-8-31 22:23
verilog的结构化、数据流、行为级描述方式
verilo ，verilog ，数据流
EDA 技术 gaochy1126 2023-8-31 0 3350 gaochy1126 2023-8-31 22:23
verilog中的基本数据类型
端口 ，verilo ，verilog ，数据类型
EDA 技术 gaochy1126 2023-8-31 0 3343 gaochy1126 2023-8-31 22:22
Verilog 模块例化
verilo ，verilog
EDA 技术 gaochy1126 2023-8-31 0 3310 gaochy1126 2023-8-31 22:22
verilog仿真文件数组初始化出错 attach_img
verilo ，verilog ，仿真
FPGA论坛 比神乐 2023-7-28 2 3643 比神乐 2023-10-28 09:49
VERILOG重点解析
verilo ，verilog
EDA 技术 gaochy1126 2023-5-29 0 3286 gaochy1126 2023-5-29 16:13
ALWAYS语句
电路 ，verilog ，verilo ，组合 ，代码 ，综合
EDA 技术 gaochy1126 2023-5-29 0 3187 gaochy1126 2023-5-29 16:12
FUNCTION —— VERILOG的函数
IO ，TI ，function ，verilo ，verilog
EDA 技术 gaochy1126 2023-5-29 0 3233 gaochy1126 2023-5-29 16:09
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