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Verilog HDL的故事 流水操作和建模.pdf attachment
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FPGA论坛 雷北城 2021-8-16 0 4531 雷北城 2021-8-16 15:25
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EDA 技术 gaochy1126 2020-11-13 0 734 gaochy1126 2020-11-13 10:21
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FPGA论坛 雷北城 2020-12-7 0 615 雷北城 2020-12-7 18:54
基于Verilog HDL的异步FIFO设计与实现.pdf attachment
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FPGA论坛 雷北城 2021-6-3 0 2271 雷北城 2021-6-3 15:38
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FPGA论坛 雷北城 2021-5-17 0 690 雷北城 2021-5-17 14:47
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FPGA论坛 雷北城 2021-4-14 0 835 雷北城 2021-4-14 16:28
可综合的Verilog语法和语义的资料 attachment
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EDA 技术 gaochy1126 2021-3-25 0 913 gaochy1126 2021-3-25 21:45
VERILOG HDL入门 attachment
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关于算法的描述问题
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新手求助（弱弱的问一句，谢谢大家）
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595上升沿串行数据输入和下降沿串行输出的VERILOG HDL
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急！急！急！心急如焚，请各位帮忙指点
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华为Verilog HDL入门资料 attachment
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FPGA论坛 wangjun88 2010-8-24 0 2455 wangjun88 2010-8-24 09:52
[转贴] 用VerilogHDL实现I2C总线功能
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FPGA论坛 sherry88 2010-8-27 0 2113 sherry88 2010-8-27 09:37
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学习CPLD
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FPGA论坛 阳阳314 2012-9-25 0 1513 阳阳314 2012-9-25 15:04
[转]解决初学者疑惑：VHDL、Verilog，System+verilog比较
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