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请教stm32cubemx中的debug serial wire选项问题 attach_img
BUG ，Serial ，Wire ，STM32CubeMX ，代码
ST MCU nuc990 2017-9-15 13 5676 xbwpc 2017-9-18 21:53
我用51端口模拟i2c和1-wire总线的程序 attachment
Wire ，总线 ，端口 ，模拟I2C
侃单片机论坛 JasonWangSE 2013-12-22 12 2989 3htech 2013-12-24 11:26
示例：基于C++模板技术的1-wire总线编程 attachment digest
编程 ，C++ ，模板 ，总线 ，Wire
侃单片机论坛 john_lee 2010-10-9 12 6256 abin0415 2012-4-29 02:10
Verilog中begin...end和fork....join的区别和用法
TEST ，Wire ，Input ，npu ，verilog ，FOR
EDA 技术 gaochy1126 2023-2-18 12 4568 gaochy1126 2023-2-28 22:13
Verilog中reg和wire的区别总结
设计 ，输入输出 ，模块 ，输出 ，Wire ，verilog
EDA 技术 gaochy1126 2023-2-18 12 3827 gaochy1126 2023-2-28 22:15
Verilog中wire与reg类型的区别
信号 ，组合 ，触发 ，输出 ，verilog ，Wire
EDA 技术 gaochy1126 2023-2-18 12 4113 gaochy1126 2023-2-28 22:11
使用 PSIO 实作 Microwire 协定 attach_img
Micro ，Wire ，ps ，IO ，AC
新唐MCU 734774645 2020-5-28 11 873 guanjiaer 2020-6-5 18:20
【转】UART/I2C/SPI/1-wire四大通信接口的神解释 attach_img
ar ，pi ，通信接口 ，spi ，UART ，Wire
GigaDevice GD32 MCU 我喜欢打游戏 2022-5-3 11 1611 onebank 2022-6-1 17:14
reg和wire有什么区别啊？
时序逻辑 ，时序 ，逻辑 ，逻辑电路 ，电路 ，Wire
Microchip Henryko 2023-12-18 11 1987 蝶弄美人簪 2025-12-24 21:12
关于名字“受不了你”的说明
Wire ，寄存器 ，时序 ，时序逻辑
FPGA论坛 受不了你 2011-12-11 11 2875 hongchengway 2011-12-12 20:43
chipscope可看的信号类型是什么？
ChipScope ，信号 ，Wire
FPGA论坛 星星之火红 2011-7-12 11 4146 GoldSunMonkey 2012-3-18 18:00
DS18B20多个并在一起，线长了就读不出来怎么办？[已解决]
DS18B20 ，Wire ，se ，dc ，unsigned
侃单片机论坛 SUNKE9 2010-4-1 11 7437 一路向北lm 2018-5-12 06:09
将 Arduino 代码迁移至 STM32CubeIDE
Arduino ，Wire ，代码 ，AN ，迁移 ，STM32CubeIDE
ST MCU Hitomi22 2026-2-20 10 13 Clyde011 2026-2-22 09:14
配置工程时没有选中Serial Wire导致程序不能再次下载怎么办？
方法 ，引脚 ，boot ，Wire ，Serial
ST MCU Henryko 2024-3-29 10 1576 一只眠羊 2024-4-18 15:07
加密芯片ATSHA204A单总线（Single-Wire Interface, SWI）协议 attach_img
interface ，Wire ，single ，单总线 ，加密芯片 ，ATSHA204
Microchip Libby@ 2024-7-11 10 2657 神明祷告 2025-11-26 15:29
JK触发器消除毛刺 attach_img
JK触发器 ，Wire ，ST ，RS ，npu
FPGA论坛 anstxfw 2012-11-19 10 3116 hawksabre 2012-11-22 06:58
1－wire总线
Wire ，总线
GigaDevice GD32 MCU 历史暴君 2017-10-31 9 1258 历史暴君 2017-10-31 21:18
嵌套状态机请教
状态机 ，LED ，Wire ，Output ，TPU
FPGA论坛 jlgcumt 2010-5-20 9 4427 jlgcumt 2010-5-27 09:53
fft ip核使用问题 attach_img
ip核 ，fft ，Wire ，ST ，SCALE
FPGA论坛 bulonghu 2013-1-5 9 4609 zhushouxi 2013-1-7 21:02
VERILOG怎么样实现顶层文件调用其他模块？
verilog ，Wire ，TI ，TPU ，Output
FPGA论坛 wrr891208 2013-5-28 9 24279 liwei028 2020-4-15 10:41
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