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HDB3 verilog FPGA论坛 resky1990 2012-5-24 0 1536 resky1990 2012-5-24 10:48
求教
osMOSTECANverilog
EDA 技术 caoqing1314 2012-5-20 1 2490 GoldSunMonkey 2012-5-20 23:53
Verilog读取文本文件的问题
veriloggeniTIse
FPGA论坛 swe21 2012-5-16 8 8805 swe21 2012-5-30 10:20
用verilog HDL设计电子时钟 新手园地 蒙meng 2012-5-15 9 2087 wukunshan 2012-5-27 20:56
verilog的一个问题
veriloggeedgeSTos
FPGA论坛 dobypig 2012-5-15 6 1514 可木 2012-5-18 00:02
跟着我从零开始入门FPGA(一周入门XXOO系列) attach_img EDA 技术 McuPlayer 2012-5-13 158 21458 wanghui9010 2012-7-26 15:40
北大verilog课件!内部资料 attachment FPGA论坛 lirfv 2012-4-25 12 1828 brace1108 2012-5-4 23:10
请教:verilog实现的UART模块中波特率的时钟分频问题…… FPGA论坛 yuxiang2008 2012-4-18 9 5507 hawksabre 2012-12-27 18:28
verilog 赋初值的问题
verilogTPUOutputgeInput
新手园地 就是一枪 2012-4-16 1 2485 zuxingshui 2012-4-17 23:22
Verilog中参数型常量问题 FPGA论坛 aikimi7 2012-4-12 7 3137 liedc 2012-4-24 10:22
请问FPGA,DSP,Verilog,matlab之间是什么关系? FPGA论坛 jbbppa 2012-4-9 5 3723 GoldSunMonkey 2012-4-12 10:52
为什么要学verilog
verilogveriloHDLVHDLhd
EDA 技术 海川先生 2012-4-1 11 2145 热血的人 2012-5-26 10:42
请教兄弟们一个verilog的程序问题 FPGA论坛 skiry 2012-3-27 7 1780 skiry 2012-3-28 08:27
一个verilog的问题:用户自定义原语(UDP)是不是无法综合? FPGA论坛 lonelyking1716 2012-3-26 1 2185 GoldSunMonkey 2012-3-26 21:02
Verilog小数定标问题 FPGA论坛 aikimi7 2012-3-26 6 2018 aikimi7 2012-3-28 20:24
Verilog小数定标问题 FPGA论坛 aikimi7 2012-3-26 0 1161 aikimi7 2012-3-26 10:10
verilog 的IEEE标准 1364-2001 attachment FPGA论坛 viatuzi 2012-3-24 2 1971 GoldSunMonkey 2012-9-7 17:56
请教个verilog问题.想不明白
verilogmoduleFORninpu
FPGA论坛 zjsyjbb 2012-3-23 8 1587 GoldSunMonkey 2012-3-26 20:52
运行频率和时钟频率的区别 attach_img FPGA论坛 aikimi7 2012-3-22 6 2053 aikimi7 2012-3-23 10:02
流水线设计 attach_img FPGA论坛 aikimi7 2012-3-22 1 1102 Backkom80 2012-3-22 10:09