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听说Altera 的Stratix V不行了？ altera Stratix 星星之火红 2012-9-18 10:27 1 1658
我仿真生成的波形文件太大了不能打开仿真 module modules yuhaijian0112 2012-9-18 09:43 4 3113
Xilinx Returns to DAC XILINX return DAC 星星之火红 2012-9-18 09:41 10 1830
如何用erilog语言构造一个ram？ wuhaidianzi 2012-9-18 09:30 2 1159
请教版主这个要更新驱动的问题怎么解决？ TE AC ma9453 2012-9-18 09:28 15 2593
大家看下这个简单的VHDL的程序 VHDL ic wrigleymint 2012-9-18 00:18 3 1773
怎样获得电路运行所需时间？电路 UART ST dwananqinyan 2012-9-17 23:47 1 1415
基于DSP_FPGA分层图像处理技术的智能相机设计 DSP FPGA 图像处理技术 daisy露 2012-9-17 22:33 9 2470
FPGA驱动，FPGA例化的BRAM添加到ARM的文件系统分区，驱动？ ARM BRAM fpga驱动 y646635088 2012-9-17 22:22 7 1722
Verilog代码命名六大黄金规则 verilog代码信号 xjsxjtu 2012-9-17 22:20 8 2214
FPGA管脚交换出现问题 FPGA 管脚交换软件阮天宇00 2012-9-17 22:10 2 1524
用现场可编程门阵列实现的频率计频率计信号 GoldSunMonkey 2012-9-17 22:09 7 2264
ADS62P48前变压器设计 ADS 变压器设计信号 weishukongji 2012-9-17 18:37 1 1721
Verilog(FPGACPLD)设计小技巧 FPGACPLD verilog qwempty 2012-9-17 18:35 4 1917
[matlab] 自定义ip核问题~ ip核信号总线 mage100 2012-9-17 18:34 11 3266
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请教spartan3的MIG生成的DDR2 SDRAM控制器的相关问题 ...2 SDRAM控制器 spartan3 DDR zy7598865 2012-9-16 20:51 32 6392
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