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HRDATA受不受ready的影响?
2018-9-10 19:02 0 146
ahb incr不能跨越1kB地址边界
2018-9-10 19:00 0 564
exclusive 访问数据空间
2018-9-10 18:58 0 179
没有数据传输要求得Busy 状态与IDLE状态有什么区别?
2018-9-10 18:56 0 216
输入数据寄存的工作时钟
2018-9-10 18:54 0 186
四个相同的AHB2SRAM的slave可否用一个multiplexor挂在AHB-lite bus matrix上?
2018-9-10 18:52 0 320
AXI3一个transaction中多个transfer有AWID相同,WID不同的使用场景么?
2018-9-10 18:50 0 580
W channel 需要加入buffer吗?
2018-9-10 18:48 0 438
总结理解一下:interleave需要master和slave都需要BUF,reorder只有master需要BUF?
2018-9-10 18:46 0 503
总线从power domain A到power domain B都需要注意什么?
2018-9-10 18:44 0 419
AXI中为什么不去掉RID
2018-9-10 18:42 0 343
请再具体描述一下axi的拓扑
2018-9-10 18:40 0 277
增加寄存器避免亚稳态,但这能保证输出逻辑是正确的么?
2018-9-10 18:38 0 221
亚稳态二级处理的原理
2018-9-10 18:36 0 140
如果C1前面又接了个寄存器C0,那c1是Launch时钟还是Capture时钟啊,这个时钟域还是C2吗
2018-9-10 18:34 0 200
同步时钟为啥一定要同源
2018-9-10 18:32 0 491
需要整个flow的要点
2018-9-10 18:30 0 122
亚稳态发生串扰导致系统崩溃,有这样的案例吗
2018-9-10 18:28 0 277
WDATA_BUFFER0的深度
2018-9-10 18:26 0 227
MDL延迟补偿的算法
2018-9-10 18:24 0 227
一个refresh刷新一行?还是全刷?如果是只刷新一行的话,是不是会有下面的问题
2018-9-10 18:22 0 263
ddr3读的时候为什么dq和dqs是沿对齐的?
2018-9-10 18:20 0 326
提到的DDR速度单位是频率还是速率
2018-9-10 18:18 0 219
RFU是什么缩写?什么意思?
2018-9-10 18:16 0 1167
多周期约束问题加法器。。。。
2018-9-10 18:14 0 230
多周期约束问题加法器。。
2018-9-10 18:12 0 239
多周期约束问题加法器
2018-9-10 18:10 0 274
同步复位和异步复位的选择
2018-9-10 18:08 0 420
异步复位同步释放,是能解决毛刺产生的复位问题吗,如果不能的话,如何解决毛刺的问题呢
2018-9-10 18:06 0 402
异步复位实训中reset.v中
2018-9-10 18:04 0 366
步复位实训中reset.v中
2018-9-10 18:02 0 208
异步信号是否可以未经同步两拍后就能使用。。。
2018-9-10 18:00 0 311
异步信号是否可以未经同步两拍后就能使用。。
2018-9-10 17:58 0 282
异步信号是否可以未经同步两拍后就能使用。
2018-9-10 17:56 0 314
握手电路为啥可以使用两级同步处理。。。
2018-9-10 17:54 0 245
握手电路为啥可以使用两级同步处理。.
2018-9-10 17:52 0 189
握手电路为啥可以使用两级同步处理。1
2018-9-10 17:50 0 153
快时钟同步到慢时钟域怎么进行电平的扩展
2018-9-10 17:48 0 336
慢时钟域到快时钟域单bit打两拍2倍频率问题
2018-9-10 17:46 0 249
如果直接用D1,采样的信号是不稳定的。这个原因是?
2018-9-10 17:44 0 421
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