新手园地

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如何查看设置的NDR信息 des Design HC 没名字的人 2018-9-10 14:14 0 183
怎么区分哪些buffer/inverter是CTS插入的，哪些是原Verilog网表里的？ buffer INVERTER verilog 第十代火影 2018-9-10 14:12 0 352
怎么删掉NDR规则？命令大碴子味 2018-9-10 14:10 0 172
invert和buff混用 Lab 3月的尾巴 2018-9-10 14:08 0 114
set_ccopt_property 用法 property se INVERTER 无幻 2018-9-10 14:06 0 437
signoff阶段发现有些Corner/view下有20多个CTS TREE NET的MAX TRANS违反 NET view 求关注啊 2018-9-10 14:04 0 374
ctd_win看不到其他时钟结构 win 时钟 CAN roucun 2018-9-10 14:02 0 177
取消选中的instance颜色显示 AN ce ST 稻花香1号 2018-9-10 14:00 0 251
ccopt如何把多个时钟放到一个skew group里 Group 时钟肉坨坨 2018-9-10 13:58 0 479
做CTS delay corner 应该怎么选取，选best，还是worst，还是两个corner 迭代做？ ST RS 哈金 2018-9-10 13:56 0 396
问老师 ISO rule中 -clamp_value 0/1是什么意思? ISO 博斯 2018-9-10 13:54 0 289
请问老师，path delay是啥意思？向量 hd 香菇选手 2018-9-10 13:52 0 309
dft memory bist memory ST 冰糖炖雪梨 2018-9-10 13:50 0 199
如何理解MBIST的sharebus概念？ Share ST mb 第三章 2018-9-10 13:48 0 1475
lookup table table BLE 第8号打板工 2018-9-10 13:46 0 162
Fix_drv的问题 ck target TE 电子学长 2018-9-10 13:44 0 158
如果发现时钟分叉过早,该怎么处理? 时钟爱德华复制手 2018-9-10 13:42 0 225
基于Anchor Driver的CTS,是不是clock source点先到达这个anchor再开始CTS driver source ck kaloulin 2018-9-10 13:40 0 230
anchor的clock tree结果变成这样还有意义吗？ ck AN root 白鹭hu 2018-9-10 13:38 0 205
为什么要先用ecoAddrepeter 来加anchor driver? ADDR driver Peter 白板就是这个 2018-9-10 13:36 0 330
怎么用CTD 界面选中一条时钟树路径呢？只能选择一段一段的时钟时钟树王将 2018-9-10 13:34 0 209
为什么multi source group 不需要锁定增加的四个instance吗 Group Multi source 王将 2018-9-10 13:32 0 218
插入的anchor的clock tree还是一样的，不知道错在哪一步？ AN ck ADDR スモモ 2018-9-10 13:30 0 148
anchor driver 和guide buffer是一回事吗？ buffer driver guide 白板就是这个 2018-9-10 13:28 0 358
修正hold violation的简要流程 vi TI IO 一片混沌 2018-9-10 13:26 0 153
请问能讲解下吗 IO setup vi 白板就是这个 2018-9-10 13:24 0 194
设置 setLimitedAccessFeature ccopt_native_pro 1失败 access DAC EDA 那个叫黑的人 2018-9-10 13:22 0 414
做clone的修drv, 不会导致这个gete的上一级的fanout增多，产生新的问题吗 TE ge AN 没名字的人 2018-9-10 13:20 0 138
为什么我做的ccopt_pro 只对76个违反的地方进行了rebuffering buffer 求关注啊 2018-9-10 13:18 0 165
怎么报report_ccopt_clock_tree_violations -file violation.rpt？ Report vi TI 第三章 2018-9-10 13:16 0 151
clock gate 和 clock logic 有什么区别？ TE ic 过期账户 2018-9-10 13:14 0 125
问func_HF 和func_ST 没有成功读入 ST TE tc 哈金 2018-9-10 13:12 0 139
问怎么将已经做好的tree fix住？ CAN AN 小蘭 2018-9-10 13:10 0 148
基于view做的时钟，为什么skew group 有8个？ Group view 时钟白板就是这个 2018-9-10 13:08 0 240
不同时钟的skew group设置，怎么设置 Group 时钟一亚麻怡 2018-9-10 13:06 0 256
为什么不加约束进行ccopt_design-cts 工具不对tree做balance? Balance Design view 一片混沌 2018-9-10 13:04 0 422
请问MMMC 与multi view 做clock tree有什么区别？ Multi view vi 第8号打板工 2018-9-10 13:02 0 228
如果有多个clock 需要做tree并且相互之间可能有talk，怎么样才能使比较重要的tree先做好后不被更改？ ck TE 棋王高手 2018-9-10 13:00 0 341
create_ccopt_clock_tree_spec 后面不加任何参数，此时产生的spec file在那里？ TE ck 一亚麻怡 2018-9-10 12:58 0 329
GPU集成开发 GPU 集成开发 SOC 哈金 2018-9-10 12:56 0 205