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arm的命名规则是怎么定的,为啥家R4,R5,R7,R8,R52,那么R6?R9,R10……会预留给那些呢?
2018-9-9 13:52 0 272
R8的dmips是多少
2018-9-9 13:50 0 390
中频芯片可不可以用A系列做控制吗? 比如A53
2018-9-9 13:48 0 244
面向智能驾驶,有没有A和R的多核异构SOC,R用于做实时的task,A做高性能的运算
2018-9-9 13:46 0 333
问一个问题,哈佛结构的CPU,我如何定义一块内存为指令区域或者数据区域,是不是我只需要在scatter file中定义好了...
2018-9-9 13:44 0 441
下一代r系列也会考虑ccl 模式的多核扩展模式吗?类似a系列
2018-9-9 13:42 0 254
做r4axi总线桥下的emif,会收到乱序写么
2018-9-9 13:40 0 173
R5的MIPIS多少? 或算力如何估算?
2018-9-9 13:38 0 234
多核执行程序是怎样的?
2018-9-9 13:36 0 143
IPCM和gic自带的sgi中断机制有啥联系或者区别吗?
2018-9-9 13:34 0 396
Freescale MC9S12xep适用吗?做控制器
2018-9-9 13:32 0 418
请问未来5年AI发展趋势如何?
2018-9-9 13:30 0 206
处理Inout端口-设计和测试平台编写
2018-9-9 13:28 0 557
AXI 4 UPsizer Downsizer模块的协议检查器WSTRB出错?
2018-9-9 13:26 0 531
APB从站应何时从APB主站读取/写入事务的采样地址/数据?
2018-9-9 13:24 0 384
[ARM GICv3-GIC流协议]正在从CPU接口检索中断!
2018-9-9 13:22 0 383
是否有同时使用HWDATA和HRDATA的情况?
2018-9-9 13:20 0 424
AHB中的BURST功能起什么作用?
2018-9-9 13:18 0 427
为什么AHB从站需要HBURST信号?
2018-9-9 13:16 0 362
具有负载存储架构的简单处理器能否支持BURST?
2018-9-9 13:14 0 388
包装BURST传输有什么目的?
2018-9-9 13:12 0 182
在APB总线上进行多次传输的断言?
2018-9-9 13:10 0 314
[AXI协议]是否允许主机禁用非窄WRAP突发中的字节通道?
2018-9-9 13:08 0 343
Amba自适应流量配置文件问题
2018-9-9 13:06 0 277
AHB-Lite协议状态机
2018-9-9 13:04 0 371
Axi4写入交易
2018-9-9 13:02 0 274
如何将AHB接口添加到具有Load Store架构的处理器?
2018-9-9 13:00 0 382
写事务期间pstrb =“ 0000”或“ 0101”时的APB处理?
2018-9-9 12:58 0 282
写事务期间pstrb =“ 0000”或“ 0101”时的APB处理
2018-9-9 12:56 0 331
AHB-Lite协议是否要求对主处理器进行流水线处理?
2018-9-9 12:54 0 410
AMBA
2018-9-9 12:52 0 463
如果在AHB的WRAP txn中未对齐,则从响应中期望得到什么
2018-9-9 12:50 0 342
PSEL = 0时APB3从机响应
2018-9-9 12:48 0 315
关于重试响应
2018-9-9 12:46 0 216
突发终止,在AHB上进行忙转移
2018-9-9 12:44 0 386
AHB从AHB3修订为AHB5,区别是?
2018-9-9 12:42 0 549
AXI3写数据与相同的AWID交织
2018-9-9 12:40 0 465
哈佛结构一直都不太清楚什么地方放code,什么地方放数据
2018-9-9 12:38 0 267
AXI-lite tlast signal missing and tready behavioral
2018-9-9 12:36 0 375
How to understand Exclusive
2018-9-9 12:34 0 334
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