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[verilog] 初学Verilog,出现的错误解决不了,求帮忙 新人帖 5 2654 夏天的微笑 2015-8-8 littbi 2017-12-17 11:09
[verilog] 刚学Verilog,编了下面的程序,仿真时运行出不来结果 attach_img 1 376 JasonnLee 2015-7-28 littbi 2017-12-17 11:07
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[FPGA] 勇敢的芯伴你玩转Altera FPGA连载32:可综合的语法子集3 attach_img 1 174 rousong1989 2017-12-14 修一明 2017-12-15 09:39
[FPGA] 我的 VGA 模块来了,含视频教程。大家看看 attach_img  ...2345 89 7164 王紫豪 2014-4-10 fswyt 2017-12-14 21:28
如果CPLD的资源达到了90多,对逻辑和时序有何影响? attach_img 6 290 小研究 2017-12-3 thinkabout4451 2017-12-14 10:32
[Quartus] quartus14引脚分配的时候为什么会出现tck,tms,tdo,tdi attach_img 2 293 平漂流 2017-12-12 平漂流 2017-12-13 22:47
[FPGA] 数字时钟管理器IP核的使用 新人帖 0 95 hnliucan520 2017-12-13 hnliucan520 2017-12-13 09:36
[FPGA] 勇敢的芯伴你玩转Altera FPGA连载31:可综合的语法子集2 attach_img 0 111 rousong1989 2017-12-12 rousong1989 2017-12-12 20:47
[FPGA] 勇敢的芯伴你玩转Altera FPGA连载28: 内里本质探索——器件... attach_img 1 188 rousong1989 2017-11-30 littbi 2017-12-12 15:39
[FPGA] zynq的串口中断不能触发问题 6 2376 colinjen 2014-1-15 zxq6 2017-12-12 07:26
[FPGA] 请问一个高速数据存储的方案。 7 633 zsuhh 2016-12-15 摘桃花换酒 2017-12-11 10:37
[verilog] verilog 写的串口 在一个状态机里面,有一个寄存器无法执... attach_img 14 652 ok407371195 2017-1-3 littbi 2017-12-10 22:35
[verilog] testbench的设置问题 新人帖 4 280 wyp1998911 2017-11-4 littbi 2017-12-10 21:53
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[FPGA] cyclone iii 是不是没有 rgmii 和 gmii 硬核 1 189 速度是有方向的 2017-12-7 ar_dong 2017-12-9 08:51
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