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热烈庆祝赛灵思公司成立28周年! attach_img
2012-2-7 17:12 8 2475
FPGA相关 FPGA的分类
2012-2-7 17:06 0 1878
新手急求!!!!关于ep1cq240c8 attach_img
2012-2-7 14:51 2 2435
chipscope中端口的输入信号
2012-2-6 21:08 6 3549
晶体管技术方案面临瓶颈
2012-2-6 20:23 2 1973
面向动态应用的灵活操作系统
2012-2-6 19:50 0 1691
堆叠与载入:Xilinx SSI、 28Gbps I/O 打造令人惊叹的FPGA  ...2
2012-2-5 23:36 32 4886
最热的电子技术精品,网上卖疯了 attachment
2012-2-5 22:34 16 2953
请教GSM,DCM2中的复位信号怎么接?
2012-2-5 22:23 6 2400
赛灵思28nm“独家秘籍”产品开疆辟土定义设计新时代
2012-2-5 22:22 6 1999
[verilog] 赛灵思 ISE 13.2 设计套件
2012-2-5 12:45 0 1761
堆叠与载入:Xilinx SSI、 28Gbps I/O 打造令人惊叹的FPGA
2012-2-5 12:40 0 1990
[verilog] 赛灵思 7 系列 FPGA 强大系统集成能力
2012-2-4 22:35 6 2071
Xst:2211警告是什么含义?要紧吗?
2012-2-4 21:14 8 5331
【Xilinx 北京招聘】 Sr IO Specialist FAE
2012-2-3 21:57 18 3663
请教:DCM2中RST信号怎么接?
2012-2-3 21:42 4 2063
请教一下BPI FLASH配置的问题。
2012-2-3 18:11 12 5673
还在悲催上班的举个手吧  ...2
2012-2-3 17:32 21 3770
openRISC1200感兴趣的有木有,报名了,  ...2
2012-2-3 17:05 25 4488
v5的功耗问题
2012-2-3 13:35 2 2426
X家S6 输出时钟需要走全局时钟管脚吗?
2012-2-3 12:51 4 2107
求virtex-4 系列下的XC4VFX60FF1152的IBIS仿真模型。求助! attachment
2012-2-3 12:48 8 2100
求virtex-4 系列下的XC4VFX60FF1152的IBIS仿真模型。求助!
2012-2-2 22:05 11 2501
[modelsim] FWFT相比FIFO有什么优势吗  ...2
2012-2-2 22:01 20 6456
[matlab] 赛灵思发布 ISE 13.4 设计套件
2012-2-2 16:58 7 2001
基于FPGA的QPSK信号源的设计与实现
2012-2-2 16:49 2 2031
多频连续波雷达数据实时压缩算法设计
2012-2-2 16:42 3 2281
采用FPGA实现视频应用中的OSD设计
2012-2-1 20:43 0 1657
Zynq-7000 可扩展式处理平台现已供货 attach_img  ...23
2012-2-1 15:59 50 5092
有谁知道DXP Altinm里面有一些关于FPGA的那些功能怎么用?
2012-2-1 15:57 7 1928
中文资料:用 SPI Flash 存储器配置 Spartan-3E FPGA attach_img  ...2
2012-2-1 15:55 37 5453
[verilog] 热烈庆祝赛灵思发布世界最大FPGA attachment  ...2
2012-2-1 15:24 21 5650
状态机异常
2012-2-1 14:50 7 2517
[Quartus] DDR controller
2012-2-1 11:54 7 3065
需要Uart的IP核,求帮助 attachment
2012-2-1 11:51 8 2310
EPCS选型时,EP4SGX530 = 189,000,000 bits这个数据是哪来的? attach_img
2012-2-1 09:35 4 4598
active在VHDL中是关键字吗?
2012-1-31 22:06 0 1964
怎么产生coe文件.
2012-1-31 16:50 14 14093
请教:Xst:2591 这样的警告要紧吗?
2012-1-30 14:07 4 2015
请教:怎么对输出时钟进行约束?
2012-1-28 10:24 7 3156
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