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[CPLD] 单片机与FPGA串_并行通信设计 attachment  ...2
2013-9-13 21:23 39 7303
[matlab] 我与赛灵思的2012+ISE13.1设计流程介绍 attachment
2013-9-13 20:38 2 2455
请教AUrora GTP使用的问题
2013-9-13 18:15 1 1654
[FPGA] 请帮忙推荐F28M35+Spartan 3e开发板
2013-9-13 15:19 5 4418
[FPGA] 实际的FPGA项目,模块间调用是否都是靠使能标志位?
2013-9-13 10:46 2 2099
有关quartus与modelsim6.5b仿真报错的问题仿真 attachment agree  ...2
2013-9-12 23:07 25 6617
[verilog] xilinx verilog 编写IIC程序,从机TCA6416APW,求高手指导 attach_img
2013-9-12 21:18 1 2499
求助!!这个警告什么意思,需不需要理会? attach_img
2013-9-12 17:46 9 17279
请高手帮忙FPGA选型
2013-9-12 08:12 9 2406
重大好消息——赛灵思20nm UltraScale架构All Programmable器件开始 agree
2013-9-11 20:42 13 2231
[FPGA] 这个是代码没写好吗? attach_img
2013-9-11 19:21 3 1396
求大神指点!quartus II这些变量被编译器当作clk怎么解除?? attach_img
2013-9-11 18:52 5 2386
[FPGA] 逻辑控制问题
2013-9-11 18:02 2 1718
[FPGA] 基于I2C的数码管显示问题 attach_img
2013-9-11 16:20 2 1875
[FPGA] NANDFLASH读写中R/B#信号的变化
2013-9-11 15:57 0 1495
XILINX在Transceiver用户手册里提出了对模拟电源的文波噪声要求
2013-9-11 10:48 6 2142
Xilinx 推出全新的 FPGA 设计方法培训课程 agree
2013-9-11 10:48 8 1432
[FPGA] 官方开发板问题
2013-9-11 08:42 1 1294
读写FPGA FIFO问题?
2013-9-11 08:16 7 1863
[FPGA] 提高工作效率的利器 attach_img
2013-9-10 22:47 2 1458
[FPGA] mig产生DDR2写数据问题请教 attach_img
2013-9-10 20:03 9 1789
测试11
2013-9-10 18:10 0 842
测试9
2013-9-10 18:03 0 731
请教AD
2013-9-10 14:03 7 1660
Simulink GBK ERR 中文字符 不能保存问题
2013-9-10 11:15 9 3044
测试9
2013-9-9 23:58 0 1003
测试7
2013-9-9 23:50 0 831
用V7GTH的自驱动能力简化评估链路性能
2013-9-9 23:50 5 1387
高举本土大旗,FPGA市场冲出黑马 agree
2013-9-9 23:43 3 1940
[FPGA] 想学FPGA 哪款比较合适
2013-9-9 19:57 12 1766
测试4
2013-9-9 19:11 0 689
FPGA可帮助搜索引擎降低功耗和碳排放
2013-9-8 23:44 0 1508
Altera提供经过全面验证的EtherCAT协议IP,前端许可免费
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Altera演示Cavium OCTEON®多核处理器的Interlaken互联
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赛普拉斯发布集成了USB的超低功耗PSoC 1器件
2013-9-8 23:37 1 1542
[CPLD] CPLD
2013-9-8 23:37 1 1595
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FPGA寄存器的上电初值
2013-9-7 23:36 14 7007
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