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[FPGA] modelsim仿真一直在Loading,也不报错,怎么弄啊?
2013-8-25 13:40 5 4616
如何让FPGA画圆
2013-8-25 00:05 10 3142
cupl语言实现分频
2013-8-25 00:04 2 1502
FPGA能否软件复位?
2013-8-25 00:03 15 3788
[FPGA] verilog 语言写ad822的采集用大dac900回放 attach_img
2013-8-24 10:27 4 1912
关于zynq启动的问题,求达人解答!
2013-8-23 23:22 1 1410
MAX3000和EX64用哪个好?
2013-8-23 23:21 1 1003
[FPGA] 求教下IP核怎么设置啊?
2013-8-23 18:51 2 1613
[FPGA] FPGA板子焊接问题
2013-8-23 16:00 0 1553
发布 iCore 双核心板 NIOSII 基础例程。。。 attach_img  ...2
2013-8-23 09:55 39 4486
【求助】硬件实现协议卸载
2013-8-22 21:27 1 1257
chipscope触发条件设置 attachment
2013-8-22 21:18 14 6984
spartan6和virtex6开发难度一样吗
2013-8-22 21:09 4 2133
Microblaze 从 UART 接收数据例程
2013-8-22 19:31 1 3804
【求助】硬件实现协议卸载
2013-8-22 15:24 1 1076
quartus ii 11.0的toggle rate在哪里设置?
2013-8-22 10:56 0 2433
rom 查找表
2013-8-21 22:16 3 1593
PCIE core的ucf约束文件
2013-8-21 14:53 3 2261
关于DDR2的布线
2013-8-20 22:13 4 2737
[FPGA] FPGA问题(这标题) attach_img
2013-8-20 19:57 2 1508
[FPGA] FPGA实现等效采样的时钟问题
2013-8-20 19:47 0 1376
怎么知道xilinx库函数中包括哪些component?
2013-8-20 15:08 0 1276
[FPGA] FPGA是什么?FPGA现状?怎样学习FPGA?
2013-8-20 15:04 2 1741
FPGA是什么?FPGA现状?怎样学习FPGA?
2013-8-20 10:31 0 1203
[CPLD] 请教廉价CPLD实现I2C的方案
2013-8-20 08:30 6 2170
[modelsim] 用ise14.2的几个错误怎么解决
2013-8-20 08:17 2 4010
[FPGA] Fpga低温出现故障,部分逻辑出现异常
2013-8-20 08:13 5 4840
[FPGA] altera ddr ip的问题,cyclone4是否不支持ddr sdram的ip? attachment
2013-8-20 08:11 3 2321
求基于FPGA的(DDS)任意信号发生器????
2013-8-20 08:10 3 2162
PGA选型
2013-8-19 21:30 9 2166
基于DDS的任意信号发生器设计 attachment
2013-8-19 19:21 8 2569
verilog 程序,新手,求指点 attach_img
2013-8-19 10:48 2 1932
[Quartus] TimeQuest中状态机的状态输出被当做基本时钟是为什么? attach_img
2013-8-19 10:13 1 2432
[FPGA] 电路的逻辑出现错误?
2013-8-19 08:14 2 1422
vivado使用遇到问题,求解答。
2013-8-18 18:46 0 2204
[verilog] 一个关于AD828的驱动程序,求各位大神指教指教一下
2013-8-18 16:14 9 2163
三段式verilog状态机,写好状态机还真不容易,求指导
2013-8-17 23:29 0 1366
加载程序在复位后为何还存在 attach_img
2013-8-17 13:37 6 1546
[CPLD] 请教关于晶振给fpga提供时钟的问题  ...2
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[FPGA] 赛灵思的片子,对信号取反竟然有错误,有图,请教各位 attach_img
2013-8-16 17:56 14 3091
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