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ISE 错误 se des Design zhuxinyu2008 2013-10-5 09:24 10 6285
xilinx spartan6 MCB读写DDR2的仿真问题 DDR spartan6 仿真 simpletv 2013-10-4 10:24 10 5485
[FPGA] fpga 硬件设计 FPGA 硬件设计端口 zq19891212 2013-10-2 17:41 2 1495
门控时钟 ...2 时钟代码计数器 ifpga 2013-10-1 17:53 34 9412
一种多芯片串行收发器纠偏方法芯片收发器相位 GoldSunMonkey 2013-9-30 13:53 8 3351
spartan6 MCB仿真求助仿真 spartan6 DDR sha527 2013-9-30 11:08 9 2505
[CPLD] TMS320VC5409A的时序问题，谢谢了时序 TMS320 DSP zhubright 2013-9-30 09:02 5 1561
Modelsim ROM ip 仿真原创哦 ROM modelsim 仿真 cuianbin 2013-9-29 23:10 4 4442
[matlab] Xilinx DCM原理及其设计 ...2 3 DCM XILINX dc hjjnet 2013-9-28 19:17 45 10154
顶层模块干嘛了？ AN top module jakfens 2013-9-28 15:21 14 8044
想问一下怎样用modelsim仿真quartusii中的原理图文件？？ modelsim 仿真 1014291919 2013-9-28 15:19 1 1258
MAX II中的UFM数据可以直接输出吗？ fm MAXII llx 2013-9-27 23:52 1 2971
quartusii不能选器件器件 victor3l 2013-9-27 23:23 2 2229
[FPGA] 工程中状态机突然全部跳转到默认状态 aikimi7 2013-9-27 22:56 9 2298
can't open project--Quartus II CAN project TLZme 2013-9-27 22:19 4 3000
[FPGA] 为什么广播电视SDI解析音频信号的时钟要从视频时钟分频得出时钟分频电视 zhulin 2013-9-27 16:16 6 1772
[verilog] 新手请教，如何在工程中使用行为模块？ zhang-sb23 2013-9-27 12:55 3 1448
[FPGA] xilinx floating_point这个核 FLOATING point XILINX ailnyg 2013-9-26 19:09 1 1362
[modelsim] Modelsim 中do 文件编写怎么调不出内部波形编写 modelsim ST 志在千里 2013-9-26 17:37 2 2039
安装quartusii 11.0出现了问题 ce ICE 1014291919 2013-9-26 15:41 1 1572
用FPGA做数字滤波器 FPGA 数字滤波器频率范围 zgqzgq456 2013-9-25 21:11 0 1399
[FPGA] XILINX 的 ISE ，怎么在原理图里将输入和输出直接连接起来？ se 原理图 XILINX ngyg12 2013-9-25 18:53 4 4905
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