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[CPLD] 就想用最小的CPLD器件产生个m序列，熟练的兄弟给指导个 CPLD器件 ISP 芯片 zdtdl 2015-7-8 17:52 3 1196
求助。如何编写程序检测10010序列编写随机序列 weiwu0809 2015-7-8 17:51 3 871
[matlab] VHDL设计举例：步进电机控制器程序设计步进电机控制器 VHDL设计 ST yun888 2015-7-8 17:45 1 3247
[FPGA] xilinx或Altear管脚锁定能否同AD9同步 LTE XILINX 管脚 yulib135 2015-7-8 17:42 3 885
[matlab] VHDL设计举例：伪随机数产生器伪随机数 VHDL设计 AN nan678 2015-7-8 16:48 1 4428
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[FPGA] FPGA资料 FPGA PGA AC 陌路绝途 2015-7-7 21:53 0 624
如何前期分配IO－xilinx-Planahead IO XILINX PlanAhead Backkom80 2015-7-7 15:23 8 3300
用CPLD片子实现个m序列，画的原理图不知道哪里有问题啊原理图 AC zdtdl 2015-7-6 21:11 4 1031
[FPGA] 最近在学习altera的cyclone V的soc开发板，有些问题 altera 开发板 SOC kobeshow 2015-7-6 20:47 0 1034
[VHDL] 求助~~FPGA如何实现对cameralink数据传输的控制控制 FPGA CameraLink lingxizhiwu 2015-7-5 21:51 8 3922
有没有人注意Libero IDE 9.1与8.x对比有些变化。 IDE Libero 器件 bucker 2015-7-4 18:14 0 745
[FPGA] libero ide里器件不全是怎么回事 IDE Libero 器件 00001liufei 2015-7-4 18:09 4 1166
[FPGA] 谁有vivado的*版啊求分享啊 Vivado vi AD 廊桥拾梦 2015-7-3 22:54* 9 3911
FPGA+双口RAM+PCI9054 FPGA 双口RAM PCI9054 prz1234 2015-7-3 17:29 1 1703
[FPGA] 调用ddr2 ip核时，编译出现的两个问题 DDR ip核编译 z894811350 2015-7-3 14:33 1 1681
[FPGA] FPGA实战演练逻辑篇45：减少关键路径的逻辑等级 FPGA PGA FPGA设计 rousong1989 2015-7-3 12:33 1 1013
[verilog] 关于MBI5153的问题 mb verilog 时序 yaorh 2015-7-3 12:24 1 2715
光模块在不插光纤的时候，serdes能接收到其发过来的数据 serdes 光纤光模块 cuianbin 2015-7-3 07:53 2 1843
有做过stm32 和FPGA 用FSMC通讯的么？ STM32 FPGA FSMC cuianbin 2015-7-2 22:35 12 6552
[FPGA] 新手初学习 AN AD 引脚 joelxue_123 2015-7-2 15:42 0 584
输入8位二进制数，怎样转化成0-10V在3位或4位数码管上显示呢？二进制数码管 yuzhexian 2015-7-2 07:57 2 1703
自制Spartan3开发板取得成功开发板 spartan3 PGA lxAPP 2015-7-1 11:29 2 1970
[FPGA] FPGA实战演练逻辑篇44：双向管脚的控制代码 FPGA 代码控制 rousong1989 2015-7-1 10:11 0 561
求指教：如何利用nios II读取SDRAM的存储数据图片 NIOS SDRAM NiosII 后来的我们 2015-6-30 21:33 1 3260
ISE嵌入式设计--单片机模式单片机嵌入式嵌入式设计 gaolou1991 2015-6-29 21:35 2 659
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