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FPGA基于Verilog语言的有符号乘法运算及时钟工作频率的优化 attachment
2020-4-22 15:34 1 788
[FPGA] 关于Vivado上IP核生成时总有一个dcp文件缺少的问题 attach_img
2020-4-22 15:33 5 8535
[verilog] 特权同学 Verilog边码边学 Lesson01 Vivado下载与安装
2020-4-22 09:11 0 730
[modelsim] 问下为什么看不到波形 新人帖 attachment
2020-4-21 21:33 6 985
串口功能都实现了,用modelsim仿真不出波形 attach_img
2020-4-21 16:29 2 1697
影响FPGA时序的进位链(Carry Chain), 你用对了么??
2020-4-21 15:11 0 376
[FPGA] **传奇-流水线设计之战 attachment
2020-4-19 16:31 1 509
时序约束理论篇 attachment
2020-4-19 16:30 1 553
[FPGA] 16个Altera的SOC例子(ARM部分) attachment
2020-4-18 15:57 0 542
[FPGA] **传奇-串口通信之战 attachment
2020-4-18 15:56 1 472
[FPGA] 详解FPGA的四大设计要点 attachment
2020-4-18 15:46 0 402
[FPGA] 关于FPGA培训
2020-4-17 13:56 15 1852
FPGA的技术介绍及fpga应用领域
2020-4-17 11:12 0 618
Notepad++编辑器——Verilog代码片段和语法检查 attachment
2020-4-16 22:37 2 1027
[FPGA] **传奇-字符状态机之战.pdf attachment
2020-4-16 15:37 1 541
[FPGA] Z-turn Board Xilinx Zynq-7000/7020开发板XC7Z020 有要的吗 新人帖 attachment
2020-4-16 14:52 9 1945
[FPGA] 目前正在FPGA选型,国产FPGA是否有推荐?  ...2
2020-4-15 23:12 27 4742
[FPGA] **传奇-LCD1602之战 attachment
2020-4-15 16:12 1 483
Zynq的开发四种方式 attachment
2020-4-15 15:10 0 472
VERILOG怎么样实现顶层文件调用其他模块?
2020-4-15 10:41 9 24281
[FPGA] 租 xilinx 学习板途径
2020-4-14 19:33 2 939
[FPGA] FPGA开发全攻略——时序约束 attachment
2020-4-14 15:28 1 687
[FPGA] u attach_img  ...2
2020-4-14 14:39 25 2506
[FPGA] 浙大在线FPGA数字系统设计课程,租赁解决实验板问题
2020-4-13 18:32 0 990
[Quartus] 求助,刚入门学了一些不太会这个语言 新人帖 attach_img
2020-4-12 21:40 4 894
[FPGA] FPGA基于Verilog语言的有符号乘法运算及时钟工作频率的优化 attachment
2020-4-12 16:11 0 447
[FPGA] 01_静态时序分析基本原理和时序分析模型 attachment
2020-4-12 15:53 0 484
定时器和数码管.zip attachment
2020-4-12 15:34 2 568
[FPGA] **传奇-移位和位拼运算符之战 attachment
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[FPGA] **传奇-双口RAM之战 attachment
2020-4-10 16:22 1 628
XILLINX VIVADO快速上手-HDL流程-内含视频、工程和中文版 新人帖 attach_img
2020-4-10 08:43 3 734
[verilog] 求助!第一次写测试文件,请教大神哪里出问题了? 新人帖 attach_img
2020-4-9 17:16 6 962
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[已经解决]<EP4CE115>问题
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