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请问VERILOG 的U_PixFifo是什么意思?
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用verilog来模拟eeprom的读写功能 FPGA论坛 yuhaijian112 2012-7-17 2 2372 GoldSunMonkey 2012-7-17 23:54
最近在编写一个verilog hdl代码,遇到一个问题求助 侃单片机论坛 DMCY99 2012-9-28 2 1790 Wayner 2012-9-29 21:19
新人求救 k8051IP核运用 新手园地 jiemo 2013-5-16 2 1346 jiemo 2013-5-18 16:49
我在以前的代码基础上,又加入部分的代码,逻辑单元使用量竟然减少了,求告知 FPGA论坛 郭一 2016-8-13 2 908 wx85105157 2016-8-22 09:25
【期待课程】FPGA开发学习 公开课交流专区 guyues1 2017-7-23 2 1101 guyues1 2017-7-24 10:41
Verilog大量例程 attachment FPGA论坛 dameihuaxia 2020-8-8 2 647 AKOO 2020-8-25 11:21
verilog仿真文件数组初始化出错 attach_img FPGA论坛 比神乐 2023-7-28 2 4350 比神乐 2023-10-28 09:49
vhdl和verilog哪个好?
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veriloghdl里 位数不同的两个变量怎么赋值 啊 EDA 技术 _horse 2007-9-19 2 4258 _horse 2007-9-19 21:24
如何用异步fifo实现跨时钟的数据转换 FPGA论坛 chenqinte 2010-9-10 2 2777 wxfxwk1986 2010-9-11 11:25
VHDL类属参数在verilog中怎么对应?
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Verilog中的行为级,RTL级,门电路级都代表什么意思? FPGA论坛 weshiluwei6 2011-10-29 2 4542 weshiluwei6 2011-10-30 09:56
verilog--虚拟器件和虚拟接口模型 attachment ZLG plato_yu 2011-12-5 2 2316 xlhtracy 2011-12-20 12:51
cordic算法verilog实现(复杂版) FPGA论坛 xjsxjtu 2012-10-17 2 2199 GoldSunMonkey 2012-10-29 23:00
学习Verilog必走的3个阶段
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CASE语句内部能嵌入CASE语句么---VERILOG可综合编程 FPGA论坛 magic_yuan 2014-7-11 2 3979 亚历山大Y 2014-7-12 21:22
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