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VHDL类属参数在verilog中怎么对应?
HDLverilogVHDLverilohd
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Verilog中的行为级,RTL级,门电路级都代表什么意思? FPGA论坛 weshiluwei6 2011-10-29 2 4265 weshiluwei6 2011-10-30 09:56
verilog--虚拟器件和虚拟接口模型 attachment ZLG plato_yu 2011-12-5 2 2173 xlhtracy 2011-12-20 12:51
cordic算法verilog实现(复杂版) FPGA论坛 xjsxjtu 2012-10-17 2 2109 GoldSunMonkey 2012-10-29 23:00
新人求救 k8051IP核运用 新手园地 jiemo 2013-5-16 2 1255 jiemo 2013-5-18 16:49
我在以前的代码基础上,又加入部分的代码,逻辑单元使用量竟然减少了,求告知 FPGA论坛 郭一 2016-8-13 2 845 wx85105157 2016-8-22 09:25
Verilog大量例程 attachment FPGA论坛 dameihuaxia 2020-8-8 2 584 AKOO 2020-8-25 11:21
verilog仿真文件数组初始化出错 attach_img FPGA论坛 比神乐 2023-7-28 2 4300 比神乐 2023-10-28 09:49
开发 Actel FPGA用什么语言
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ZLG tigris 2008-10-27 2 2564 fsyicheng 2008-11-1 11:44
请教一个verilog语法问题:
verilogedgeosovse
EDA 技术 likee 2008-5-28 2 2700 qiya_s 2008-6-5 17:08
quartus中的锁相环和Verilog的链接问题 attach_img FPGA论坛 kpengs 2010-5-12 2 5164 kpengs 2010-5-13 19:20
请问各位高手,如何入门SOPC FPGA论坛 zidanesaha10 2011-2-5 2 1921 chene123 2011-2-10 23:18
verilog 可综合问题 FPGA论坛 magic_yuan 2011-10-5 2 1838 magic_yuan 2011-10-8 14:23
Verilog HDL--有限状态机 attachment ZLG plato_yu 2011-12-5 2 1723 yangli1981 2011-12-5 14:10
学习Verilog必走的3个阶段
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verilog的学习需要注意什么 EDA 技术 wangdezhi 2013-7-25 2 1414 梅花望青竹 2013-7-25 10:15
CY8C55中UDB模块Verilog的存储器 英飞凌MCU论坛 nefusmzj 2013-8-19 2 1637 nefusmzj 2013-8-19 15:29
请verilog教编译中出现的一个普遍的warning
verilog编译warningckST
EDA 技术 imkakac 2007-9-23 2 3060 wayner 2007-9-26 16:27
综合前后仿真不一致 ZLG bit6019 2010-8-13 2 1743 金鱼木鱼 2010-8-20 18:56
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