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cordic算法verilog实现（简单版）
Cordic算法 ，verilog ，os ，Input ，npu
FPGA论坛 xjsxjtu 2012-10-17 6 2423 雷北城 2020-12-25 11:00
求教 verilog实现与门电路 为什么波形不对啊
电路 ，verilog ，module ，TI ，DM
EDA 技术 yuxiao2117 2012-10-17 2 1983 GoldSunMonkey 2012-10-20 14:08
verilog开发经验。
verilog ，代码 ，信号 ，硬件 ，调试
FPGA论坛 星星之火红 2012-10-17 11 2092 jiang390625 2012-10-18 16:57
Verilog讨论组精彩内容摘录
verilog ，FPGA ，PGA ，TE ，TI
FPGA论坛 星星之火红 2012-10-17 0 1429 星星之火红 2012-10-17 12:58
Verilog/VHDL 语言描述规范
VHDL ，verilog ，源文件 ，VerilogHDL ，信号
FPGA论坛 星星之火红 2012-10-16 2 1990 星星之火红 2012-10-16 20:45
再论初学者如何学习FPGA！
FPGA ，ic ，verilo ，verilog ，编程
FPGA论坛 lxAPP 2012-10-15 2 1871 星星之火红 2012-10-16 20:49
FPGA Prototyping ByVerilog Examples
Prototyping ，Examples ，FPGA ，verilog ，AN
FPGA论坛 xjsxjtu 2012-10-15 0 1549 xjsxjtu 2012-10-15 15:22
Verilog HDL 学习要点总结(二)
verilog ，HDL ，控制 ，信号 ，时序
FPGA论坛 shang651 2012-10-14 1 2023 GoldSunMonkey 2012-10-14 20:42
Verilog HDL 学习要点总结(一)
verilog ，HDL ，电路 ，器件 ，元件
FPGA论坛 shang651 2012-10-14 0 2050 shang651 2012-10-14 20:39
verilog设计经验点滴
verilog ，Wire ，AD ，TE ，Example
FPGA论坛 wmsk 2012-10-14 1 1761 GoldSunMonkey 2012-10-14 20:45
Verilog设计经验谈
verilog ，Wire ，AD ，TE ，Example
FPGA论坛 wmsk 2012-10-14 2 1687 syshuai 2013-6-17 10:08
深入分析verilog阻塞和非阻塞赋值
verilog ，阻塞赋值 ，ST ，RS ，npu
FPGA论坛 星星之火红 2012-10-14 1 1926 星星之火红 2012-10-14 17:46
学习FPGA需要注意的几个重要问题
FPGA ，verilog ，UART ，仿真 ，Quartus
FPGA论坛 shang651 2012-10-13 2 1470 GoldSunMonkey 2012-10-13 20:15
Verilog的数据类型
verilog ，数据类型 ，寄存器 ，仿真 ，TE
FPGA论坛 shang651 2012-10-13 13 2687 hawksabre 2013-1-6 20:28
Verilog assign和always 注意事宜
verilog ，ge ，edge ，时序 ，时序逻辑
FPGA论坛 星星之火红 2012-10-13 12 2424 Backkom80 2012-11-14 08:11
深入浅出FPGA-3-verilog HDL
verilog ，FPGA ，HDL ，仿真 ，sd
FPGA论坛 星星之火红 2012-10-13 1 1226 星星之火红 2012-10-13 18:42
深入浅出FPGA-2-让source insight 支持verilog HDL
Insight ，verilog ，source ，HDL ，FPGA
FPGA论坛 星星之火红 2012-10-13 0 1386 星星之火红 2012-10-13 18:41
如何检测24位数中连续0的最大个数
verilog ，verilo
FPGA论坛 robbins37 2012-10-10 7 1895 GoldSunMonkey 2012-10-12 12:51
选择VHDL还是Verilog
HDL ，verilog ，VHDL ，verilo ，hd
FPGA论坛 星星之火红 2012-10-10 1 1529 星星之火红 2012-10-10 17:50
Verilog的两个误区
verilog ，阻塞 ，阻塞赋值 ，时序 ，se
FPGA论坛 xiao6666 2012-10-14 5 1750 lxAPP 2012-10-29 22:54
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