今日: 2|主题: 14266|帖子: 104572 收藏 (180)
在quartus的qsf文件里如何将两个双向口连起来
2013-12-1 21:35 1 1651
[Quartus] nios的引脚分配问题 attach_img
2013-12-1 10:56 0 1551
[verilog] 请教一个问题
2013-11-28 13:10 11 1653
来求助了,quartus怎么生成不了可编程的文件啊????
2013-11-28 10:05 3 1984
基于FPGA的高速数据采集控制模块设计
2013-11-27 21:11 1 2154
[verilog] 一个时钟下降沿计数,经常检测不到下降沿 attach_img
2013-11-27 15:42 9 2267
[FPGA] 关于isop补偿滤波器的系统函数表达
2013-11-27 15:22 9 3088
[FPGA] ise 布局布线不通过
2013-11-27 14:59 7 3202
[FPGA] PCI9054
2013-11-27 11:43 3 1944
[FPGA] 关于JTAG下载时出现的问题
2013-11-26 22:40 0 1088
[FPGA] 这是软件版本的问题吗? attach_img
2013-11-26 22:15 3 1602
[FPGA] quaartus中调用modelsim遇到了一些问题,求助 attach_img
2013-11-26 14:56 3 1589
simple Dual-port RAM使用问题
2013-11-25 23:25 1 2335
VHDL有符号数的表示
2013-11-25 20:19 0 1818
char *s=(void *)(onchip_memory_base+256)是什么意思
2013-11-25 17:24 0 1224
FPGA项目外包,高手请进  ...2
2013-11-25 16:21 22 4286
如何正确使用FPGA的时钟资源 attach_img agree  ...2
2013-11-25 16:18 24 3754
chipscope 能显示连续变化的波形么?  ...2
2013-11-25 10:21 26 8772
请问RW485SIAMOND协议是什么协议啊
2013-11-25 08:57 0 1038
[FPGA] 有人愿意赚钱写个USB上位机程序么?
2013-11-24 22:09 12 2290
[modelsim] 用modelsim给testbench编译时的问题
2013-11-24 21:20 2 2020
究竟学习FPGA需要哪些基础的知识  ...234
2013-11-24 20:28 61 11631
Matlab文件的读取和写入
2013-11-23 14:16 2 3781
求解 为什么编译过后没有执行任何逻辑
2013-11-23 12:37 1 1163
[FPGA] Rapidio IP core attach_img
2013-11-22 16:46 0 1403
关于FPGA的IP核的使用问题,请教下
2013-11-22 10:31 7 1596
FPGA实现车牌识别
2013-11-22 08:50 0 1597
安富利GSM给您说说ModelSim仿真XILINX库添加 attach_img digest agree  ...23
2013-11-21 23:01 45 10247
if(1)有效不行,if(!0)则可以,望解答
2013-11-21 19:49 5 1498
[FPGA] V4的板子上有块V2的扩展版,但是找不到资料!
2013-11-21 15:17 0 1028
[FPGA] DDR中mcb控制器中调试时calib_done变高后怎么又变低了
2013-11-21 15:10 3 1579
[FPGA] 请问FPGA目前最高能频率能有几G啊
2013-11-21 12:50 1 1624
介绍FPGA的综合
2013-11-20 21:21 1 1197
[Quartus] Quartus编译问题 attachment
2013-11-19 23:04 4 4158
[Quartus] quartus 11.0SP1报错!!!!
2013-11-19 21:27 0 2470
[CPLD] MachXO640相关问题
2013-11-19 17:05 0 1318
[FPGA] UART串口通信 attach_img
2013-11-19 12:49 7 1928
利用实验室的FPGA开发板读SIM卡
2013-11-18 16:11 1 1439
请问ISE报错-logical block
2013-11-17 22:04 2 1773
[FPGA] 请指教,到底是我设计有问题,还是XILINX FPGA或板有问题 attach_img
2013-11-17 21:54 7 1721
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