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量产了没?
2012-12-5 22:26 12 1943
怎么阅读ise生成的文件? attach_img
2012-12-5 22:25 2 1823
Timing Closure on FPGAs
2012-12-5 19:05 7 1898
spartan-6最大输入时钟频率
2012-12-5 19:02 1 4127
大神进来看看我的warning啊
2012-12-5 18:52 8 3013
Explore the Vivado HLS Design Assistant Today!
2012-12-5 13:18 3 2218
好玩的JTAG链。大家知道是什么原因吗? attach_img
2012-12-4 23:31 12 2818
求基于VHDL的USB通信的代码
2012-12-4 22:18 3 2347
Xilinx VHDL 时序问题怎么解决
2012-12-4 22:15 9 2176
XILINX的FPGA芯片架构剖析
2012-12-4 21:51 7 2696
ua741可正常工作的需要供电电压范围是多少?
2012-12-4 21:49 1 4019
FPGA IO 输出输出电阻
2012-12-4 17:33 8 3196
Linux驱动入门
2012-12-4 17:28 7 2659
[Quartus] 基于FPGA的一种高速图形帧存设计
2012-12-4 13:09 8 1893
STM32实现SPI通信问题求解
2012-12-4 12:49 5 3660
请大家看看我的小i程序有什么问题(请尽量指出)
2012-12-4 12:11 7 2073
mig初学者
2012-12-4 11:27 7 2208
FPGA求助
2012-12-4 08:41 4 1288
[CPLD] 基于FPGA的伪随机序列的生成方法及应用
2012-12-3 21:55 3 2453
[Quartus] 基于FPGA控制的温度检测无线发射接收系统
2012-12-3 21:55 3 2342
求救啊,为什么这个引脚不能作为时钟输入! attach_img
2012-12-3 21:49 7 2403
异构处理器开发趋势:用OpenCL开发嵌入式混合代码
2012-12-3 21:34 5 2061
FPGA做算法
2012-12-3 17:47 12 2913
EP1C3T100C8N中文数据手册(求)
2012-12-3 10:07 0 3617
FPGA中IP核的生成(回复给分) attach_img  ...2
2012-12-2 22:05 28 4205
FPGA的光纤通信接口控制芯片设计
2012-12-2 21:37 6 3351
Verilog HDL---复杂数字系统的构成
2012-12-2 20:07 6 2445
求助这个E1电路选用哪种FPGA芯片比较好 attach_img
2012-12-1 23:21 0 1500
安富利公司赛灵思 FPGA VxWorks 技术研讨会 - 北京
2012-12-1 22:24 5 2880
[VHDL] 基于FPGA的高速数据采集系统接口设计
2012-12-1 21:22 1 2207
[CPLD] 基于FPGA的多通道高速CMOS图像采集系统
2012-12-1 21:21 1 2216
ISE 中全局时钟缓冲问题
2012-12-1 20:57 14 3544
大家聊聊了解芯片内部结构对我们设计的重要性
2012-12-1 20:44 4 2017
FIR数字滤波
2012-11-30 20:12 5 2207
VHDL最基础的一个问题
2012-11-30 19:43 9 2140
[VHDL] 基于XilinxMicroBlaze的嵌入式GPS接收机研究 attachment
2012-11-30 19:20 2 1549
cpld与fpga的一点疑问
2012-11-30 19:19 11 2812
有谁用过tlk1501么 attachment
2012-11-30 18:44 5 3060
用verilog写两个数差的绝对值
2012-11-30 18:39 8 3849
SDRAM问题
2012-11-30 17:54 3 2826
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