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找书把人就找的气死了。请老T叔帮忙。 attach_img
HDL ，prime ，Primer ，verilog ，VerilogHDL
电子技术交流论坛 dongshan 2011-8-7 7 2756 xxddqq2008 2011-8-8 13:48
Verilog HDL三种建模方式
HDL ，verilog ，建模 ，VerilogHDL ，IEEE
FPGA论坛 星星之火红 2012-11-8 7 3982 yghanwuji 2013-10-12 12:18
verilog HDL 与 VHDL的区别
verilog ，VHDL ，VerilogHDL
EDA 技术 51xlf 2013-3-6 7 11863 elec921 2013-3-21 08:32
请大家看看我的小i程序有什么问题(请尽量指出)
C语言 ，HDL ，LED ，verilog ，VerilogHDL
FPGA论坛 pihois 2012-11-30 7 2205 jahnson066 2012-12-4 12:11
VerilogHDL语法疑问
VerilogHDL ，ge ，RS ，se ，ST
EDA 技术 sukejia 2008-6-22 6 2479 shyfish 2008-8-29 15:48
VHDL转verilogHDL
VerilogHDL ，VHDL ，代码
FPGA论坛 daixi520 2014-1-11 6 1944 zhangrenxin091 2014-5-14 18:08
一个简单的VerilogHDL程序仿真波形出错，求解！
程序仿真 ，VerilogHDL ，RS ，ST ，TE
FPGA论坛 wang1987 2011-8-19 5 2328 viatuzi 2011-8-19 23:58
Verilog HDL和VHDL的比较
verilog ，VHDL ，电路 ，硬件 ，VerilogHDL
EDA 技术 awey 2008-1-18 5 3810 windymeng 2008-1-23 18:02
一个比较奇怪的问题，关于下载
altera ，TE ，verilo ，编译 ，VerilogHDL
EDA 技术 shouzhou 2007-11-10 4 2140 vongy 2007-11-12 19:17
FPGA求助
FPGA ，HDL ，hd ，verilog ，VerilogHDL
FPGA论坛 gibenlin 2012-11-30 4 1391 seavend0603 2012-12-4 08:41
USB2_0控制器CY7C68013与FPGA接口的VerilogHDL实现 attachment
CY7C68013 ，FPGA ，USB ，VerilogHDL ，接口
电子技术交流论坛 mmuuss586 2013-6-16 3 1878 mmuuss586 2013-6-16 15:59
数据截位
HDL ，verilog ，VerilogHDL ，verilo ，hd
EDA 技术 上官紫虞 2014-8-12 3 1806 合体后代 2014-9-3 17:37
QuartusII13.0使用教程详解 attach_img
ar ，quartusII ，AC ，TE ，nex ，VerilogHDL
EDA 技术 gaochy1126 2021-5-29 3 4177 gaochy1126 2021-5-29 07:30
怎样将模拟信号解调成数字信号，用VerilogHDL实现 attach_img
VerilogHDL ，数字信号 ，模拟信号 ，信号解调 ，AC
FPGA论坛 ljss1104 2015-3-26 3 1716 windycraze 2015-5-29 10:08
veriloghdl里 位数不同的两个变量怎么赋值 啊
HDL ，verilog ，VerilogHDL ，verilo ，hd
EDA 技术 _horse 2007-9-19 2 4509 _horse 2007-9-19 21:24
verilog hdl硬件描述语言(中文教程) attachment
HDL ，verilog ，硬件描述语言 ，VerilogHDL
ZLG 想实习去 2010-1-17 6 3395 aqua2013 2016-6-10 22:01
Verilog HDL 与VHDL的区别
verilog ，VHDL ，Quartus ，UART ，VerilogHDL
FPGA论坛 mjx91282041 2011-3-1 2 3038 armsnow 2011-3-4 21:08
Verilog HDL程序设计与实践 attachment
HDL ，verilog ，VerilogHDL ，part1
ZLG 3B1105 2011-7-9 7 3093 即时生效 2011-7-21 16:39
Verilog/VHDL 语言描述规范
VHDL ，verilog ，源文件 ，VerilogHDL ，信号
FPGA论坛 星星之火红 2012-10-16 2 2236 星星之火红 2012-10-16 20:45
调试一个UART程序，用verilogHDL写的
UART ，VerilogHDL ，调试 ，仿真 ，时序
FPGA论坛 幻月舞姬 2015-5-28 4 1794 幻月舞姬 2015-9-3 09:23
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