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夏闻宇Verilog HDL课件，不会让您失望的 attachment
HDL ，verilog ，verilo ，hd ，AC
FPGA论坛 xjsxjtu 2012-9-8 10 3502 lxAPP 2012-11-10 21:47
【活动贴】Cadence® Verilog® Language and Simulation attachment
cadence ，language ，simulation ，verilog ，AC
EDA 技术 RaiseCom 2013-4-17 10 2201 panjunren 2013-10-22 16:12
关于编写verilog代码的小心得 attach_img
编写 ，代码 ，verilog代码 ，verilog ，verilo
Microchip 咕咕呱呱孤寡 2024-9-14 10 20596 世纪女孩 2025-11-18 15:18
求Verilog黄金参考指南电子文档 attachment
verilog ，电子 ，verilo
FPGA论坛 lxAPP 2011-11-6 10 2910 GoldSunMonkey 2011-11-22 14:28
根据我的经验学习Verilog意见分享
verilog代码 ，仿真 ，代码 ，verilog ，verilo
Microchip meiyaolei 2024-9-12 10 2924 meiyaolei 2024-9-14 14:04
FPGA编程问题
FPGA编程 ，时钟 ，管脚 ，verilog ，信号
FPGA论坛 hbicecream 2011-8-5 10 2782 lxc806705 2011-8-9 14:27
关于verilog请教下 attach_img
verilog ，TE ，TPU ，npu ，Output
EDA 技术 zhaigch 2009-11-28 10 2773 ic00 2009-12-4 22:38
关于用的FPGA做位同步时钟提取问题，求大神进来指导！
FPGA ，位同步时钟 ，verilog ，光纤 ，光纤传输
FPGA论坛 hutianyu 2013-10-9 10 2217 haitaox 2013-10-15 16:12
哪位大哥用verilog写过CRC16校验程序？ attach_img
CRC16校验 ，校验程序 ，verilog ，串口 ，串口传输
FPGA论坛 tzj123456tjz 2013-2-21 10 8236 guohao2243856 2013-10-16 10:05
求救，verilog初学者问题，急急急
verilog ，se ，TE ，module ，TI
EDA 技术 mapo365 2007-6-3 10 6034 xzhiguo 2007-10-16 09:28
求助：如何将自己写的verilog模块封装成IP核
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FPGA论坛 sainbrady 2010-10-25 10 14299 bairan168 2011-5-12 17:06
Verilog初学者遇到的问题，请教各位！
verilog ，寄存器 ，TPU ，module ，Output
FPGA论坛 andy_mqy 2011-3-11 10 3510 AutoESL 2011-6-2 15:32
奇数倍分频（Verilog）
verilog ，verilo ，触发 ，触发器
FPGA论坛 AutoESL 2011-7-18 10 2598 xwj 2011-7-21 08:26
verilog能实现倍频吗？
verilog ，倍频 ，HDL ，PLL ，VerilogHDL
FPGA论坛 shell.albert 2012-8-24 10 19631 GoldSunMonkey 2012-8-30 09:13
深入浅出FPGA-3-verilog HDL
verilog ，FPGA ，HDL ，仿真 ，建模
FPGA论坛 星星之火红 2012-11-5 10 2843 hero2009nj 2013-10-10 15:17
请问这个时序verilog如何实现 attach_img
verilog ，时序 ，AC ，时钟 ，倍频
FPGA论坛 laihama 2012-11-15 10 2871 xiao6666 2012-11-24 20:27
新手求教，Verilog 写的抢答器 attach_img
抢答器 ，verilog ，ck ，AC ，ov
EDA 技术 jim727 2012-12-12 10 2891 zhaorj8780 2013-1-16 18:59
如何学好Verilog
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万利电子 gxgclg 2013-5-28 10 1873 angerbird 2013-6-15 19:15
verilog parmater的问题
ARMA ，verilog ，TE ，meter ，parameter
FPGA论坛 kdurant 2013-7-26 10 2924 GoldSunMonkey 2013-7-29 21:32
用verilog 写 u（k）=u（k-1）+error 怎么写 attach_img
verilog ，RS ，ST ，ge ，edge
FPGA论坛 18910748101 2017-1-12 10 1699 nethopper 2017-1-13 15:20
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