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如何用verilog写一个倍频器
verilog ，倍频器 ，倍频 ，verilo
EDA 技术 xyzyyb86 2009-6-1 10 20429 zhaolqjn 2009-11-15 19:21
【求助】谁有A/D和D/A转换的verilog的程序啊？？？ attachment
verilog ，verilo ，D/A转换 ，d/a ，a/d
EDA 技术 fydbyhz 2009-8-5 10 4832 GoldSunMonkey 2013-5-16 23:10
关于verilog请教下 attach_img
verilog ，TE ，TPU ，npu ，Output
EDA 技术 zhaigch 2009-11-28 10 2669 ic00 2009-12-4 22:38
verilog hdl 编写的传输门
HDL ，编写 ，verilog ，IO ，module
ZLG 米其林r 2010-3-22 10 4765 conghung2011 2011-12-1 15:17
verilog HDL寄存器元素赋值问题
HDL ，verilog ，寄存器 ，TE
EDA 技术 欧阳青云 2010-7-18 10 7281 luckyaya 2010-8-9 22:20
求助：如何将自己写的verilog模块封装成IP核
ip核 ，verilog ，封装 ，源码
FPGA论坛 sainbrady 2010-10-25 10 14044 bairan168 2011-5-12 17:06
Verilog初学者遇到的问题，请教各位！
verilog ，寄存器 ，TPU ，module ，Output
FPGA论坛 andy_mqy 2011-3-11 10 3401 AutoESL 2011-6-2 15:32
FPGA编程问题
FPGA编程 ，时钟 ，管脚 ，verilog ，信号
FPGA论坛 hbicecream 2011-8-5 10 2597 lxc806705 2011-8-9 14:27
求Verilog黄金参考指南电子文档 attachment
verilog ，电子 ，verilo
FPGA论坛 lxAPP 2011-11-6 10 2778 GoldSunMonkey 2011-11-22 14:28
verilog能实现倍频吗？
verilog ，倍频 ，HDL ，PLL ，VerilogHDL
FPGA论坛 shell.albert 2012-8-24 10 19491 GoldSunMonkey 2012-8-30 09:13
深入浅出FPGA-3-verilog HDL
verilog ，FPGA ，HDL ，仿真 ，建模
FPGA论坛 星星之火红 2012-11-5 10 2708 hero2009nj 2013-10-10 15:17
请问这个时序verilog如何实现 attach_img
verilog ，时序 ，AC ，时钟 ，倍频
FPGA论坛 laihama 2012-11-15 10 2671 xiao6666 2012-11-24 20:27
新手求教，Verilog 写的抢答器 attach_img
抢答器 ，verilog ，ck ，AC ，ov
EDA 技术 jim727 2012-12-12 10 2735 zhaorj8780 2013-1-16 18:59
哪位大哥用verilog写过CRC16校验程序？ attach_img
CRC16校验 ，校验程序 ，verilog ，串口 ，串口传输
FPGA论坛 tzj123456tjz 2013-2-21 10 8141 guohao2243856 2013-10-16 10:05
初学verilog，感觉遇到逻辑电路力不从心！ attach_img
verilog ，逻辑电路 ，se ，ST ，RS
FPGA论坛 黑暗小y 2013-3-8 9 2229 黑暗小y 2013-3-9 22:44
【活动贴】Cadence® Verilog® Language and Simulation attachment
cadence ，language ，simulation ，verilog ，AC
EDA 技术 RaiseCom 2013-4-17 10 2063 panjunren 2013-10-22 16:12
如何学好Verilog
verilog ，verilo
万利电子 gxgclg 2013-5-28 10 1751 angerbird 2013-6-15 19:15
verilog parmater的问题
ARMA ，verilog ，TE ，meter ，parameter
FPGA论坛 kdurant 2013-7-26 10 2837 GoldSunMonkey 2013-7-29 21:32
用verilog 写 u（k）=u（k-1）+error 怎么写 attach_img
verilog ，RS ，ST ，ge ，edge
FPGA论坛 18910748101 2017-1-12 10 1598 nethopper 2017-1-13 15:20
根据我的经验学习Verilog意见分享
verilog代码 ，仿真 ，代码 ，verilog ，verilo
Microchip meiyaolei 2024-9-12 10 2621 meiyaolei 2024-9-14 14:04
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