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[modelsim] modelsim无法建立project
2018-9-7 11:02 0 1399
请教xilinx spartan 6 DDR3硬核MCB 是否免费的
2018-9-5 17:32 3 1604
如何系统的学习FPGA 【学习的方法】
2018-9-5 16:45 5 1829
[FPGA] FPGA设计整洁代码3-信号命名和定义应该明确
2018-9-4 09:15 0 725
[FPGA] 求FMC150高速ADDA的参考设计
2018-9-3 13:53 1 1088
[FPGA] FPGA反推法应用实例——检查代码 attachment
2018-9-1 15:16 0 838
[FPGA] FPGA代码整洁之道(2)
2018-8-31 09:59 0 864
百度基于FPGA的加速平台怎么用
2018-8-30 20:34 0 806
[FPGA] FPGA 干净的代码是程序员的核心技能
2018-8-30 14:53 0 818
Pocket-RIO用户可以借助LabVIEW 平台快速完成 FPGA 开发。 attach_img
2018-8-27 15:25 0 1170
[FPGA] FPGA实际应用案例--通过反推检查代码
2018-8-27 10:06 0 664
[CPLD] 新手入门,请教一个LED的程序 新人帖 attach_img
2018-8-23 15:49 8 1460
有关100M系统时钟下赋值时序出错的问题 新人帖 attach_img
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[CPLD] EPM570最小系统构成
2018-8-20 08:25 12 2904
请教一个关于QUARTUS 13.1状态机设置的问题 新人帖 attach_img
2018-8-18 19:57 0 999
[FPGA] 萌新求助如何FPGA将模拟信号正弦波转换成占空比百分之50的方波
2018-8-17 16:00 5 2284
ZYNQ 7Z020
2018-8-16 20:29 5 2602
[FPGA] 求XC6SLX9参考原理图
2018-8-15 15:15 5 4871
[verilog] signaltap II综合assign语句的问题
2018-8-13 23:22 3 1243
[FPGA] 基于FPGA的信号处理教程
2018-8-13 11:06 0 902
[FPGA] 基于fpga的信号与处理视频
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[verilog] 各位大神有使用verilog实现RS485总线通信或者hub集线器的么,相关的资料也可~ 新人帖
2018-8-9 11:48 4 2635
[verilog] 初学者请大家帮忙看看这段代码到底错在哪儿了?找了一..... 新人帖 attach_img
2018-8-8 16:20 0 939
[CPLD] 有谁有maxv的晶振电路设计方面的资料
2018-8-8 11:45 0 745
[FPGA] 请问Libero怎么安装失败啊 attach_img
2018-8-8 10:04 4 1244
代码功能仿真正确,但在板上不行,是不是时序的问题?
2018-8-7 09:15 4 1607
[verilog] 有偿求帮忙调试一个后仿 新人帖
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[CPLD] 编译警告的问题 attachment
2018-8-4 09:48 1 580
[FPGA] 转FPGA FAE ,请问各位技术面试主要面哪些内容
2018-8-4 08:56 0 1230
[FPGA] 用FPGA能产生1nS脉冲吗? 新人帖
2018-8-3 20:46 9 6335
[FPGA] 现在想要安装ACTEL的libero11.8是不是只能用64位系统了。
2018-8-3 14:38 0 1205
[FPGA] FPGA驱动HT1621的问题 attachment
2018-8-3 08:06 2 1052
FPGA会用到外置SRAM吗?
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[FPGA] 两条DDR2怎样组成32bit数据读写 新人帖
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晒晒双FPGA板 attach_img
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[FPGA] 如何看懂别人的代码
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[verilog] 请教一下Verilog数据处理问题
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