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vhdl语法求解
VHDL ，Reset ，AN ，se ，ge
EDA 技术 damoyeren 2013-10-19 3 1251 charmless 2013-11-14 22:59
VHDL 语法求解
VHDL ，ST ，ic ，logic ，TE
EDA 技术 damoyeren 2013-10-15 0 1425 damoyeren 2013-10-15 17:18
cpld写lcd的时序，第一次写vhdl，大家帮忙看看有问题没 attach_img
CPLD ，LCD ，VHDL ，时序
FPGA论坛 zhubright 2013-9-18 6 1763 EDAbuffalo 2013-11-8 21:50
FPGA和VHDL的先后
FPGA ，VHDL ，工程师 ，硬件 ，硬件工程师
FPGA论坛 tjcdhk 2013-9-12 9 1908 wenzhiyudao 2014-4-18 16:07
VHDL与Verilog HDL的区别
verilog ，VHDL ，VerilogHDL ，硬件 ，IEEE
FPGA论坛 GoldSunMonkey 2013-9-6 0 995 GoldSunMonkey 2013-9-6 23:21
看老外如何实现按键消抖（VHDL）
VHDL ，软件 ，开关 ，硬件 ，触点
EDA 技术 梅花望青竹 2013-8-14 2 1427 梅花望青竹 2013-8-14 23:56
verilog是否有record类型
verilog ，record ，数据类型 ，HDL ，VHDL
FPGA论坛 yghanwuji 2013-8-14 1 1616 resxpl 2013-8-14 23:15
求教
信号 ，脉冲 ，HDL ，VHDL ，电路
EDA 技术 commander001 2013-8-11 14 2227 EDAbuffalo 2013-11-9 23:32
延时
HDL ，VHDL ，函数 ，hd
FPGA论坛 胡蒙云 2013-8-4 5 1928 EDAbuffalo 2013-11-8 21:10
举例说明VHDL中关于变量和信号的赋值、if语句的描述方法 attach_img
信号 ，VHDL ，电路 ，RS ，触发
FPGA论坛 mhanchen 2013-7-30 14 5279 admiration123 2015-9-25 09:16
关于位数据的写法
HDL ，VHDL ，hd ，verilog ，verilo
FPGA论坛 醉小清风 2013-7-30 2 1380 GoldSunMonkey 2013-7-31 00:02
VHDL语法问题 attach_img
HDL ，VHDL ，hd ，AC
FPGA论坛 damoyeren 2013-7-29 4 1233 crjab 2013-7-30 08:01
VHDL里一个警告的问题
VHDL ，ST ，ck ，kd ，pd
FPGA论坛 yb22771973 2013-7-22 4 1509 GoldSunMonkey 2013-7-23 00:14
VHDL函数的使用
函数 ，VHDL ，ge ，BCD ，CD
FPGA论坛 damoyeren 2013-7-18 15 1776 GoldSunMonkey 2013-7-29 21:46
VHDL分频小程序 attach_img
HDL ，VHDL ，小程序 ，hd ，计数器
FPGA论坛 damoyeren 2013-7-15 6 1298 xjsxjtu 2013-7-20 20:06
（VHDL）奇数或偶数分频器如何设计？还有占空比怎么设计的啊？
VHDL ，分频器 ，logic ，ic ，ST
FPGA论坛 Death格雷尔 2013-7-9 5 2574 GoldSunMonkey 2013-7-10 20:33
vhdl的电路设计
VHDL ，电路设计 ，信号 ，电平 ，编程
EDA 技术 h495093331 2013-7-9 8 1343 q728117579 2013-9-4 16:36
FPGA很好的资料
FPGA ，COM ，HDL ，VHDL ，编译
FPGA论坛 3721it 2013-7-4 2 1239 3721it 2013-7-5 12:00
CPLD
CPLD ，HDL ，VHDL ，控制 ，编写
FPGA论坛 fjb214 2013-9-7 1 1347 GoldSunMonkey 2013-9-8 23:37
求助：modelsim中如何对VHDL仿真
modelsim ，VHDL ，仿真 ，verilog ，verilo
FPGA论坛 nm2012 2013-10-16 7 1807 ococ 2013-10-17 15:28
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