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dm368
2012-11-22 20:44 1 2655
Microsemi推出下一代SmartFusion®2 SoC FPGA
2012-11-22 20:40 1 2146
采用FPGA提高广播应用的集成度
2012-11-22 20:39 4 1724
三角函数公式查询
2012-11-22 18:38 8 1697
求助:关于ACTEL的反熔丝FPGA的问题。
2012-11-22 13:51 2 2009
SPARTAN6的PCIE的DMA仿真问题 ?
2012-11-22 11:49 0 1924
关于FPGA的入门
2012-11-22 11:31 5 2696
怎样生成可烧录文件
2012-11-22 08:15 11 2869
赛灵思Zynq-7000 All Programmable SoC加速可信系统开发
2012-11-22 08:13 2 1613
[CPLD] Spartan3 attachment
2012-11-22 08:13 1 1557
Altera面向OpenCL的SDK 充分利用FPGA优势
2012-11-22 08:11 2 1603
赛灵思的2012:巩固28nm 遥望20nm
2012-11-22 08:11 2 1887
求助:Libero9.1中WaveFomer的使用问题 attach_img
2012-11-22 08:11 10 2433
[VHDL] 使用ZYNQ 的PS与PL进行交互(转)
2012-11-22 07:55 2 4062
JK触发器消除毛刺 attach_img agree
2012-11-22 06:58 10 2758
基于FPGA的CCD数据采集系统的设计 agree
2012-11-21 21:04 2 1784
如何把普通管脚约束到全局时钟网络上去? attach_img
2012-11-21 21:04 1 2006
请教一个VHDL仿真的问题
2012-11-21 21:02 1 1556
SPARTAN6的DDR2中odt引脚问题 attach_img
2012-11-21 16:13 16 6183
[CPLD] 异步FIFO在FPGA与DSP通信中的运用 attachment
2012-11-21 12:00 1 1635
Libero9.1烧写反熔丝的FPGA时出错。
2012-11-21 11:46 5 1890
ADI FPGA夹层卡 简化高速数据转换器与FPGA的连接
2012-11-21 08:30 2 1654
快速实现基于FPGA的脉动FIR滤波器
2012-11-21 08:29 4 1638
CRC(Cyclic Redundancy Check)算法与实现
2012-11-21 08:26 3 2596
Xilinx公布20nm发展战略 继续保持领先一代
2012-11-21 08:26 2 1207
[verilog] 使用PL做流水灯 (转) agree
2012-11-20 17:52 3 2746
在ise 原理图里添加常数输入时,如何更改输出位宽 attach_img
2012-11-20 17:44 6 3511
专用的时钟引脚与普通的引脚有什么差别
2012-11-20 17:41 9 5260
无线电频谱和波段划分
2012-11-20 17:29 1 1958
有谁能说ARM有哪些过人之处?
2012-11-20 17:28 9 2219
Verilog非阻塞赋值的仿真/综合问题 -下
2012-11-20 17:28 5 2933
IBIS 理解说明 agree
2012-11-20 17:27 5 2791
[CPLD] 基于FPGA的软件无线电平台设计 attachment
2012-11-20 17:24 1 1597
[Quartus] 用Modelsim仿真PLL_ADV和PLL_BASE时候报错
2012-11-20 17:23 2 5204
[verilog] 基于_Xilinx_FPGA_的无线通信 attachment
2012-11-20 17:23 1 1264
SPARTAN6 mcb odt 问题 第二问 ?
2012-11-20 09:47 0 1641
XC3S200A下载一次之后JTAG搜寻不到芯片 attach_img  ...2
2012-11-20 08:09 24 4994
中国通信简史 (下) ---芯世界博客 agree
2012-11-20 00:25 4 1851
说下FPGA内部类似逻辑分析仪的chipscope信号检测技巧
2012-11-20 00:25 11 3083
[verilog] Zynq交叉编译环境链的建立与C程序编写
2012-11-20 00:22 1 2343
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