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[Quartus] 使用ZYNQ 的HDMI接口(转)
2012-11-23 08:11 2 4119
[VHDL] 基于功能建模的含FPGA电路板测试方法研究
2012-11-23 08:09 1 1799
[Quartus] 基于DSP和FPGA技术的多总线伺服控制模块设计
2012-11-23 08:08 1 1715
基于DSP+FPGA协处理架构的无线子系统设计 agree
2012-11-23 08:07 2 1445
基于IP核的FPGA 设计方法 agree
2012-11-22 20:55 3 1721
基于FPGA的逆变控制系统的研究
2012-11-22 20:54 4 2155
Xilinx 汤立人:华为采用ASIC替代FPGA是误读
2012-11-22 20:53 3 2151
莱迪思推出DIAMOND 2.0软件
2012-11-22 20:53 1 2131
赛灵思推出符合PCI- E 3.0标准的集成模块
2012-11-22 20:51 2 1558
莱迪思推出中文的Power 2 You印刷版和网络版
2012-11-22 20:51 2 1988
[Quartus] 双时钟域时序约束问题
2012-11-22 20:47 5 3652
[matlab] 【求助】跑不完的P&R,郁闷
2012-11-22 20:45 4 1913
dm368
2012-11-22 20:44 1 2725
Microsemi推出下一代SmartFusion®2 SoC FPGA
2012-11-22 20:40 1 2294
采用FPGA提高广播应用的集成度
2012-11-22 20:39 4 1861
三角函数公式查询
2012-11-22 18:38 8 1776
求助:关于ACTEL的反熔丝FPGA的问题。
2012-11-22 13:51 2 2148
SPARTAN6的PCIE的DMA仿真问题 ?
2012-11-22 11:49 0 2014
关于FPGA的入门
2012-11-22 11:31 5 2780
怎样生成可烧录文件
2012-11-22 08:15 11 3043
赛灵思Zynq-7000 All Programmable SoC加速可信系统开发
2012-11-22 08:13 2 1730
[CPLD] Spartan3 attachment
2012-11-22 08:13 1 1641
Altera面向OpenCL的SDK 充分利用FPGA优势
2012-11-22 08:11 2 1734
赛灵思的2012:巩固28nm 遥望20nm
2012-11-22 08:11 2 2006
求助:Libero9.1中WaveFomer的使用问题 attach_img
2012-11-22 08:11 10 2585
[VHDL] 使用ZYNQ 的PS与PL进行交互(转)
2012-11-22 07:55 2 4234
JK触发器消除毛刺 attach_img agree
2012-11-22 06:58 10 2920
基于FPGA的CCD数据采集系统的设计 agree
2012-11-21 21:04 2 1894
如何把普通管脚约束到全局时钟网络上去? attach_img
2012-11-21 21:04 1 2059
请教一个VHDL仿真的问题
2012-11-21 21:02 1 1644
SPARTAN6的DDR2中odt引脚问题 attach_img
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[CPLD] 异步FIFO在FPGA与DSP通信中的运用 attachment
2012-11-21 12:00 1 1739
Libero9.1烧写反熔丝的FPGA时出错。
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ADI FPGA夹层卡 简化高速数据转换器与FPGA的连接
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快速实现基于FPGA的脉动FIR滤波器
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CRC(Cyclic Redundancy Check)算法与实现
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Xilinx公布20nm发展战略 继续保持领先一代
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[verilog] 使用PL做流水灯 (转) agree
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在ise 原理图里添加常数输入时,如何更改输出位宽 attach_img
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专用的时钟引脚与普通的引脚有什么差别
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