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Warning: Found 3 output pins without output pin load capacitance assignment AD Output without zhaorj8780 2013-1-13 22:18 4 6565
赛灵思System Generator时间参数深度剖析 System 赛灵思 generator lxAPP 2013-1-13 22:17 16 2154
Timing Closure on FPGAs FPGAs Timing os xjsxjtu 2013-1-13 22:16 1 1736
基于赛灵思FPGA的出租车计价器设计出租车计价器 FPGA 赛灵思星星之火红 2013-1-13 22:12 7 1844
Verilog HDL建模概述 HDL verilog 建模星星之火红 2013-1-13 22:11 13 2973
如何将从8bit的LVDS修改了10bit的LVDS接收 LVDS AC 参考设计 zbhbyc 2013-1-13 22:11 9 5818
利用赛灵思Spartan-3A FPGA搭建高等级视频监控系统 spartan-3a 视频监控系统 FPGA qingniao966 2013-1-13 22:11 4 1614
基于赛灵思Virtex-5 FPGA的Gbps无线通信基站设计通信基站 Virtex-5 星星之火红 2013-1-13 22:08 11 2237
基于赛灵思FPGA的微波辐射计数控系统设计与实现 FPGA 系统设计赛灵思 FangTT 2013-1-13 22:08 13 2558
vhdl中调用IP核以后的配置怎么写 ip核 VHDL yangguming 2013-1-13 21:56 9 2811
Xilinx 20nm产品路线图及技术细节 XILINX 路线图 FPGA jameswangchip 2013-1-13 21:55 5 2046
项目中FPGA部分实施的一点体会 FPGA 信号存储器 VBird769 2013-1-13 21:52 15 1960
利用串行RapidIO连接功能增强DSP协处理能力 DSP RapidIO 通信 qingniao966 2013-1-13 21:52 19 3536
基础知识：ASIC 和FPGA 深度比较 ASIC FPGA 基础知识 RadarEver 2013-1-13 21:51 11 2186
赛灵思可扩展式处理器平台的优势赛灵思处理器 TE RaiseCom 2013-1-13 21:51 7 1560
基于FPGA的RGB到YCrCb颜色空间转换 (1) RGB FPGA FangTT 2013-1-13 21:51 0 1531
用赛灵思FPGA实现突发数据通信中Turbo码编译 FPGA实现 turbo码赛灵思 ChaiTF 2013-1-13 21:48 7 2564
谁用过altera的stratix IV做过pcie开发，我有问题要问！！ PCIe altera Stratix hoho0ohoh 2013-1-13 21:47 8 2606
FPGA的IP核ROM问题 FPGA ip核 ROM qingkong881207 2013-1-13 21:44 8 2437
FPGA中的处理器IP概述 ip 处理器 FPGA XiaoWei369 2013-1-13 21:44 5 1456
赛灵思 ISE 12设计套件FAQ se 赛灵思时钟 xjsxjtu 2013-1-13 21:43 18 2069
程序有虫子，求大家帮忙找找(状态机部分) ST RS 静默雪原 2013-1-13 15:50 13 2112
inout 双向数据口，前仿和门级仿真都通过了，时序仿真就是时序仿真 inout zhpg009 2013-1-13 12:20 16 3253
[CPLD] 奇怪了，spartan-3a接DDR内存只能使用x8不能用x16 DDR 内存 spartan-3a drentsi 2013-1-13 10:13 1 2401
verilog学习五点经验分享 ...2 verilog 代码信号星星之火红 2013-1-13 09:23 22 3172
刚转投xilinx，还真不习惯，求指点 XILINX AC TE aceice 2013-1-13 09:22 15 2185
基于FPGA的级联结构FFT处理器的优化设计 fft处理器 FPGA 信号 RadarEver 2013-1-13 09:16 17 2917
请帮看一下CPLD完成4路视频输入1路输出分割显示,有原理图 PLD 原理图 szyzm 2013-1-12 23:01 10 4151
技巧分享：Xilinx FPGA全局时钟和第二全局时钟资源的使用方法 FPGA XILINX 时钟 XiaoWei369 2013-1-12 22:57 4 2279
Virtex-5推动超宽带通信和测距的发展测距 Virtex-5 超宽带通信 RaiseCom 2013-1-12 22:56 6 1679
基于赛灵思Spartan－3E FPGA的磁浮轴承控制系统研究 spartan 控制系统 FangTT 2013-1-12 22:56 7 1751
基于FPGA的微型数字存储系统设计数字存储微型系统设计 xjsxjtu 2013-1-12 22:53 5 1708
用FPGA 嵌入式处理器实现高性能浮点元算嵌入式处理器 FPGA pc 星星之火红 2013-1-12 22:53 7 1672
跪求大神帮助用VHDL做7分频时钟电路产生 VHDL 时钟电路信号 a322520 2013-1-12 22:50 6 2001
如何在Vivado HLS设计中定义AXI4接口接口 Vivado vi GoldSunMonkey 2013-1-12 22:48 1 1696
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设计技巧：用matlab来实现fpga功能的设计 FPGA matlab TE RadarEver 2013-1-12 22:46 8 2001
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初学FPGA，学的是Verilog，遇到问题请大神们给解答！ FPGA PGA verilog hutianyu 2013-1-12 22:45 5 1860
赛灵思Spartan®-6 FPGA 工业以太网套件介绍 FPGA spartan 工业以太网 lxAPP 2013-1-12 22:45 2 1875