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我与赛灵思的2012+可编程逻辑器件(PLD)认识与使用初步 attach_img
2013-1-6 11:17 7 2489
Xilinx USB下载线 attach_img
2013-1-5 23:01 11 2774
[Quartus] FPGA的宽带步进频率信号源设计
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[VHDL] 有谁研究过【V5】的【组播报文】接收问题?
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我与赛灵思的2012--在领先一代的All Programmable产品中快乐前行 attach_img agree  ...23456..9
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自己设计的基于FPGA的数字处理板,大家提提意见 attachment
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求取模软件
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基于FPGA的数字图像处理
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[verilog] K7 IBERT扫描测试中,UI是个什么单位?是什么意思?
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[Quartus] JTAG的TDI引脚先接FPGA和先接FLASH有何区别?
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Xilinx 配置专题之--svf attachment
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[Quartus] FPGA与DSP信号处理系统的散热设计
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为什么FPGA I/O被拉低
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“工欲善其事,必先利其器”--全面认识MicroBlaze开发套件
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如何利用赛灵思工具和技术优化FPGA功耗 attachment
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vivado不支持同步复位的综合了
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VHDL学习理解
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AFS600
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如何选择合适的FPGA千兆位收发器?
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用FPGA平台实现工业电机最大效率
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基于FPGA的步进电机控制器设计
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基于FPGA雷达成像方位脉冲压缩系统的设计
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FAE讲堂之插值查找表:实现DSP 功能的简便方法
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我与赛灵思的2012+我和VIVADO的亲密接触 attach_img agree  ...234
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[verilog] SERDES運用有問題
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阻塞赋值和非阻塞赋值,综合出来硬件上的区别??
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有没有人了解OPENCL与FPGA?
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FPGA加速无线通信系统软基站的实现 (1)
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利用Virtex-5 FPGA实现更高的性能
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非三态总线是什么意思?
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关于Xilinx FPGA的bitstream 内部数值的意义? attachment
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xilinx加载后如何复位?
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求SDK中用xilinx system C编写的AD0809程序 attachment
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视频:如何在设计中插入调试内核
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