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用schematic写的顶层文件能不能用modelsim仿真？ modelsim schematic 仿真 mentoscui 2013-1-28 21:10 3 2420
ISE约束文件的基本操作 se ST TI wmsk 2013-1-28 21:09 4 2975
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FPGA输出LVPECL转PECL的问题 FPGA LVPECL PGA cot45 2013-1-28 21:07 2 2713
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紧急求助！！！如何在planahead中查看延迟？ PlanAhead UART shiyinjita 2013-1-28 20:59 2 1647
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基于FPGA的图像处理（五）--状态机 FPGA 图像处理 LMQQ 2013-1-27 20:55 4 1582
求助 ce se TI lishaonan 2013-1-27 20:55 13 2844
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ddr2 ipcore 应用的问题 DDR IPCore 信号 lxAPP 2013-1-27 20:48 9 3604
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[VHDL] 基于PCI_X和RocketIO的高速数据传输系统设计 PCI RocketIO 系统设计 lzmm 2013-1-27 09:45 14 2803
是不是没有约束好输出约束 PCB 时钟 tmkdfan 2013-1-26 18:52 7 2139
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fpga和DSP之间进行数据传输有几种方案 DSP FPGA 数据传输 wrigleymint 2013-1-26 18:46 1 1499
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