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如何同时使用上升沿和下降沿！？ ge edge POS ywert000 2013-1-31 10:31 5 2961
2013年就要来啦，祝大家新年快乐，万事如意 XILINX 安富利 ic GoldSunMonkey 2013-1-31 10:27 14 2597
verilog与vhdl verilog VHDL 缓冲器 uiodh 2013-1-31 10:27 1 3351
编写具有100%可靠性代码的几个技巧代码编写时序 uiodh 2013-1-31 10:26 1 1826
谈谈提高FPGA设计生产力的工具、技巧和方法 FPGA设计时序时序收敛 uiodh 2013-1-31 10:23 1 1811
请教各位：fpga用从串模式配置的时候，MCU应该提供多大频率的CCLK来配置FPGA呢？ FPGA MCU PGA mucanhin 2013-1-31 10:22 5 1776
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FPGA verilog的编程心得 FPGA verilog 编程 pihois 2013-1-31 10:14 1 2215
FPGA按键防抖动，最精简的写法只有10行 FPGA C语言 mb pihois 2013-1-31 10:14 1 1803
modelsim中如何对源文件中的variable进行波形仿真？ modelsim 仿真源文件 pihois 2013-1-31 10:13 1 2084
求助串口 pigandwolf 2013-1-31 10:12 0 1085
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FPGA基础之时序设计 FPGA 时序设计时钟 xlhtracy 2013-1-31 10:11 7 2522
FPGA前辈的例子源代码，参考下 ...2 FPGA 源代码 des tee. 2013-1-31 10:02 36 5454
技术人员何去何从工程师开发工程师 ST looope 2013-1-31 10:01 1 2749
问大家一个问题 CY7C68013 FPGA PGA looope 2013-1-31 09:55 1 2810
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应该怎样写程序解决这个问题 mac 信号引脚 zrsing 2013-1-31 09:49 2 1568
请教一下括号里面东西的含义 ge ic loansat 2013-1-31 09:48 2 2590
xilinx和altera的fpga的不同之处 altera FPGA XILINX kunhuangon 2013-1-31 09:45 7 4111
在ISE中插入EDK程序 se TE ce 星星之火红 2013-1-31 09:36 4 2538
[matlab] FPGA的引脚定义有什么要求吗？ FPGA 信号 tianyi1028 2013-1-31 09:36 17 5750
求助 FOR include TI gibenlin 2013-1-31 09:33 1 1321
请教大家个问题：`include一个.v文件和直接例化一个这个文件有什么不同？ include gibenlin 2013-1-31 09:32 1 1593
Xilinx携手科通启动Zynq-7000 EPP全国6地巡回专题研讨会 Zynq-7000 研讨会 XILINX jeyma 2013-1-31 09:21 5 2052
我想读一个rom 请问怎么使能去读呢？？ ROM zrsing 2013-1-31 09:14 1 1471
S2C发布最新支持设计分割优化原型验证平台Quad V7 AD ic vi jameswangchip 2013-1-30 23:03 3 1662
Xilinx开发工具在Ubuntu下使用问题----PlanAhead XilinxSDK打开网页开发工具 sdk XILINX feihong777 2013-1-30 22:57 8 2936
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Xilinx FPGA设计约束的分类 FPGA设计 XILINX TI qingniao966 2013-1-30 22:55 9 2833
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