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k7系列的DSP48 IP核使用疑问 attach_img
2013-1-31 23:18 8 5208
Actel B3D-PM610 FPGA 离线编程器 attachment
2013-1-31 23:05 8 2816
nios ii 中读取EPCS的时候,alt_flash_open_dev这个函数打不开驱动
2013-1-31 22:38 1 4426
关于仿真!急!急!急! attach_img
2013-1-31 19:42 9 2529
[Quartus] 如何使用ise13.1 IP核生成锁相环
2013-1-31 15:48 6 4638
利用赛灵思开发工具克服FPGA I/O引脚分配挑战
2013-1-31 14:56 9 3160
跪求大仙们帮我解决一下模拟带通滤波器的问题!!!
2013-1-31 14:50 17 3106
[matlab] Win7下用哪个版本的ISE最稳定,最好? attachment
2013-1-31 13:04 18 8135
如何同时使用上升沿和下降沿!?
2013-1-31 10:31 5 2962
2013年就要来啦,祝大家新年快乐,万事如意 agree
2013-1-31 10:27 14 2608
verilog与vhdl
2013-1-31 10:27 1 3352
编写具有100%可靠性代码的几个技巧
2013-1-31 10:26 1 1828
谈谈提高FPGA设计生产力的工具、技巧和方法
2013-1-31 10:23 1 1813
请教各位:fpga用从串模式配置的时候,MCU应该提供多大频率的CCLK来配置FPGA呢?
2013-1-31 10:22 5 1783
执行Shell脚本的方式
2013-1-31 10:22 1 1757
FPGA verilog的编程心得
2013-1-31 10:14 1 2219
FPGA按键防抖动,最精简的写法只有10行
2013-1-31 10:14 1 1804
modelsim中如何对源文件中的variable进行波形仿真?
2013-1-31 10:13 1 2086
求助
2013-1-31 10:12 0 1085
用FPGA实现音频采样率的转换
2013-1-31 10:12 2 2617
ISE约束文件*.ucf的写法
2013-1-31 10:11 1 2266
FPGA基础之时序设计
2013-1-31 10:11 7 2529
FPGA前辈的例子源代码,参考下 attachment agree  ...2
2013-1-31 10:02 36 5485
技术人员何去何从
2013-1-31 10:01 1 2756
问大家一个问题
2013-1-31 09:55 1 2811
请教大家一个问题
2013-1-31 09:54 1 14222
应该怎样写程序解决这个问题
2013-1-31 09:49 2 1571
请教一下括号里面东西的含义
2013-1-31 09:48 2 2595
xilinx和altera的fpga的不同之处
2013-1-31 09:45 7 4124
在ISE中插入EDK程序
2013-1-31 09:36 4 2541
[matlab] FPGA的引脚定义有什么要求吗?
2013-1-31 09:36 17 5754
求助
2013-1-31 09:33 1 1327
请教大家个问题:`include一个.v文件和直接例化一个这个文件有什么不同?
2013-1-31 09:32 1 1593
Xilinx携手科通启动Zynq-7000 EPP全国6地巡回专题研讨会
2013-1-31 09:21 5 2060
我想读一个rom 请问怎么使能去读呢??
2013-1-31 09:14 1 1477
S2C发布最新支持设计分割优化原型验证平台Quad V7
2013-1-30 23:03 3 1665
Xilinx开发工具在Ubuntu下使用问题----PlanAhead XilinxSDK打开网页
2013-1-30 22:57 8 2941
用spartan6 做了个CPU, 还做了个编译器 ho ho ho  ...2
2013-1-30 22:57 21 4230
Altera DE2原厂版缺少实验教程 attachment  ...2
2013-1-30 22:56 20 3431
Verilog的数据类型
2013-1-30 22:56 1 2034
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