收藏本版 |订阅

今日: 0|主题: 14395|帖子: 104927

[FPGA] 关于FPGA和DSP的速度。
2014-3-13 10:09 2 1696
[VHDL] ise13.4只能进行功能仿真么?
2014-3-12 23:50 3 1567
[FPGA] Xilinx最新参考设计为客户提供业界唯一4x100G OTN转发器
2014-3-12 22:02 0 1559
[FPGA] 关于ALTERA DDR2IP 的local_ready!!!
2014-3-12 19:52 1 1902
[FPGA] 赛灵思:FPGA市场三十有成
2014-3-12 17:36 1 1278
FIFO仿真为何不对 attach_img
2014-3-12 12:08 5 1320
[FPGA] 关于Vivado时OpenTarget的一个报错。 attach_img
2014-3-12 10:28 7 2647
Cyclone 有三态IO吗?
2014-3-12 08:12 3 1910
分享几篇FPGA入门教程,希望对初学者有帮助 attachment
2014-3-11 23:57 14 2902
请教高手,使用FPGA扩展F2812并口应用的问题 attach_img
2014-3-11 23:54 8 7815
[FPGA] 找合作,HDMI【DVI】信号缩小
2014-3-11 23:50 1 1321
基于FPGA的交流电测量仪的设计
2014-3-11 23:50 5 3265
[FPGA] 准备上cy5 SoC了,有北京的朋友没
2014-3-11 23:49 4 1531
[FPGA] 新书《深入理解Altera FPGA 应用设计》出版倒计时 attach_img
2014-3-11 23:45 7 2092
[FPGA] Virtex-6的旁路电容和去耦电容。
2014-3-11 23:37 3 2131
[verilog] 如图所示,这种情况怎么完成16位数据的写? attachment
2014-3-11 10:59 5 1624
[FPGA] 求一份基于FPGA的出租车计价器毕业论文 谢谢啦
2014-3-8 09:48 3 1736
[Quartus] NIOS 调试问题
2014-3-7 23:09 4 1972
[FPGA] Xilinx 客户全定制工程创建办法
2014-3-7 16:16 0 1084
FPGA 程序时好时坏,求原因ORZ
2014-3-7 12:22 2 1183
[FPGA] xilinx spartan6做一个摄像头显示的问题
2014-3-7 08:36 2 1282
[FPGA] quartus ii编译完后提示的警告数量和下面显示的警告数量不同 attach_img
2014-3-7 08:24 1 1217
各位大神,请教CH372设置工作方式的问题
2014-3-7 00:59 8 2820
[verilog] 对一个有32位的reg变量赋值,每次只赋一位怎么实现? attach_img
2014-3-6 21:07 5 5373
[verilog] 写法不同综合出的结果有什么差异
2014-3-6 18:48 2 1751
[FPGA] 帮我看一下下面的代码什么意思啊 谢啦
2014-3-6 15:45 0 1372
[VHDL] 关于fpga里面的ram读写
2014-3-6 14:20 3 2070
载波
2014-3-6 00:11 1 1181
[FPGA] SD卡读取实验,关于利用RS232将FIFO中数据串行读出的问题
2014-3-6 00:10 4 2627
[FPGA] 如何用verilog实现时钟的相位延迟?
2014-3-6 00:08 2 4906
下一页 »

快速发帖

还可输入 80 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

在线客服 返回版块 返回顶部