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跪求大仙们帮我解决一下模拟带通滤波器的问题!!!
2013-1-31 14:50 17 2824
[matlab] Win7下用哪个版本的ISE最稳定,最好? attachment
2013-1-31 13:04 18 7812
如何同时使用上升沿和下降沿!?
2013-1-31 10:31 5 2866
2013年就要来啦,祝大家新年快乐,万事如意 agree
2013-1-31 10:27 14 2470
verilog与vhdl
2013-1-31 10:27 1 3307
编写具有100%可靠性代码的几个技巧
2013-1-31 10:26 1 1775
谈谈提高FPGA设计生产力的工具、技巧和方法
2013-1-31 10:23 1 1744
请教各位:fpga用从串模式配置的时候,MCU应该提供多大频率的CCLK来配置FPGA呢?
2013-1-31 10:22 5 1687
执行Shell脚本的方式
2013-1-31 10:22 1 1652
FPGA verilog的编程心得
2013-1-31 10:14 1 2168
FPGA按键防抖动,最精简的写法只有10行
2013-1-31 10:14 1 1747
modelsim中如何对源文件中的variable进行波形仿真?
2013-1-31 10:13 1 2048
求助
2013-1-31 10:12 0 1057
用FPGA实现音频采样率的转换
2013-1-31 10:12 2 2524
ISE约束文件*.ucf的写法
2013-1-31 10:11 1 2204
FPGA基础之时序设计
2013-1-31 10:11 7 2364
FPGA前辈的例子源代码,参考下 attachment agree  ...2
2013-1-31 10:02 36 5125
技术人员何去何从
2013-1-31 10:01 1 2516
问大家一个问题
2013-1-31 09:55 1 2760
请教大家一个问题
2013-1-31 09:54 1 14172
应该怎样写程序解决这个问题
2013-1-31 09:49 2 1525
请教一下括号里面东西的含义
2013-1-31 09:48 2 2532
xilinx和altera的fpga的不同之处
2013-1-31 09:45 7 3973
在ISE中插入EDK程序
2013-1-31 09:36 4 2456
[matlab] FPGA的引脚定义有什么要求吗?
2013-1-31 09:36 17 5540
求助
2013-1-31 09:33 1 1258
请教大家个问题:`include一个.v文件和直接例化一个这个文件有什么不同?
2013-1-31 09:32 1 1535
Xilinx携手科通启动Zynq-7000 EPP全国6地巡回专题研讨会
2013-1-31 09:21 5 1979
我想读一个rom 请问怎么使能去读呢??
2013-1-31 09:14 1 1423
S2C发布最新支持设计分割优化原型验证平台Quad V7
2013-1-30 23:03 3 1584
Xilinx开发工具在Ubuntu下使用问题----PlanAhead XilinxSDK打开网页
2013-1-30 22:57 8 2841
用spartan6 做了个CPU, 还做了个编译器 ho ho ho  ...2
2013-1-30 22:57 21 4079
Altera DE2原厂版缺少实验教程 attachment  ...2
2013-1-30 22:56 20 3295
Verilog的数据类型
2013-1-30 22:56 1 1932
Xilinx FPGA设计约束的分类
2013-1-30 22:55 9 2718
使用ModelSim自动生成状态机FSM的状态转换图
2013-1-30 22:55 1 2592
FPGA加速无线通信系统软基站的实现 (1)
2013-1-30 22:22 17 2740
FPGA加密方法
2013-1-30 22:21 0 3071
关于用CPLD控制ADC7862疑问
2013-1-30 22:20 17 2629
FPGA双雄新年展望——新产品步入新阶段 attach_img
2013-1-30 22:19 9 1926
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