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谁能帮我找到10102A 芯片的PDF
2012-11-1 22:13 4 1446
[verilog] 7系列参考时钟的抖动的描述方式改变 agree
2012-11-1 22:08 3 1832
verilog语言小节,适合忘记时翻翻 agree
2012-11-1 22:08 8 2101
DSP和FPGA在图像传输系统中的应用和实现
2012-11-1 21:38 1 1441
IC基础知识
2012-11-1 18:01 6 1881
比例乘法器 求助
2012-11-1 08:04 2 1775
FPGA中DSP slice
2012-11-1 08:01 5 4304
结合FPGA与结构化ASIC进行设计
2012-11-1 07:56 4 1475
单片机与FPGA接口通信问题
2012-11-1 07:55 4 2014
Verilog RTL级与行为级区别小结
2012-10-31 21:04 4 2384
读Flash启动失败
2012-10-31 20:58 3 2048
求教各位大侠 看看这段ISA接口程序为什么不对
2012-10-31 18:34 1 1457
HDL设计探究
2012-10-31 18:22 2 1317
[Quartus] 用SYSTEM GENERATOR遇到问题
2012-10-31 17:45 8 2422
ISE13.1使用SPI FLASH,不支持芯片ST25P32VbP吗??? attach_img  ...2
2012-10-31 17:04 22 6279
编辑器Ultraedit快捷键
2012-10-31 14:12 8 2029
[CPLD] XilinxFPGA的功耗优化设计 attachment
2012-10-31 14:11 3 1458
spartan6控制ddr2的问题 attach_img  ...2
2012-10-31 12:51 39 6878
安富利公司赛灵思 FPGA VxWorks 技术研讨会
2012-10-31 12:26 2 2220
执行Shell脚本的方式
2012-10-31 12:24 7 1934
FPGA加载时间的研究 agree
2012-10-31 12:20 7 2082
MIG的问题
2012-10-31 11:59 2 1773
[Quartus] 郁闷!资源装不下了。。。 attach_img  ...23
2012-10-31 11:23 42 6174
关于FPGA边缘检测的问题
2012-10-31 10:31 11 1672
[Quartus] XC6SLX9通过JTAG向SPI flash 下载程序失败检测不到FLASH attach_img  ...2
2012-10-31 10:17 30 10151
system generator 的问题
2012-10-31 10:13 1 2568
[CPLD] 请问没有使用FPGA管脚的输出的是什么状态
2012-10-31 08:12 7 3970
NIOS II IDE编译慢的问题
2012-10-31 08:09 6 3403
BLOCK RAM中的READ FIRST模式的疑惑 attach_img
2012-10-31 00:28 5 2794
VHDL语言详解 attachment  ...2345
2012-10-30 22:03 87 10297
关于XILINX的ip核中的最大频率和消耗资源的问题 attach_img
2012-10-30 21:53 6 3479
[Quartus] spartan6烧写spi flash失败,没有错误提示  ...23
2012-10-30 21:50 52 19426
基于CPLDFPGA和单片机的爆速仪设计.pdf attachment
2012-10-30 21:00 5 1976
UART资料 attachment
2012-10-30 20:57 5 1569
谁卖FPGA开发板
2012-10-30 08:19 4 2383
modelsim进行RTL级仿真错误,Gate-level正确
2012-10-30 08:18 5 2681
cordic算法verilog实现(复杂版)
2012-10-29 23:00 2 2197
[Quartus] spartan6 DDR2的阻抗匹配问题 ?  ...2
2012-10-29 23:00 28 6212
Verilog的两个误区
2012-10-29 22:54 5 1725
[CPLD] 赛灵思ISE13.1设计流程详解 attachment  ...2
2012-10-29 22:49 37 4602
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