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高速乘除运算，FPGA的选择 FPGA PGA 信号 jiahua1010 2011-3-24 23:36 7 3141
spi 复用配置 pi hjjnet 2011-3-24 22:41 10 2853
为什么在modelsim里仿真时PLL没有输出？仿真 modelsim PLL congfeiyu 2011-3-24 21:08 4 7525
《FPGACPLD设计工具──Xilinx+ISE使用详解》 FPGACPLD XILINX se 老大的幸福 2011-3-24 16:06 1 2636
spartan3系列器件中，vref管脚如何作为普通IO 器件管脚 vr dianzirobot 2011-3-24 14:28 1 3671
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[Quartus] Spartan6 使用过程中的问题之一---Memory接口 memory spartan spartan6 hjjnet 2011-3-23 22:12 6 2595
Microblaze 关于程序放到片外--2 Micro MICROBLAZE ic hjjnet 2011-3-23 22:08 4 2285
美国国家半导体开关稳压调整器技术问答精选2 国家半导体开关稳压 lm 小云001 2011-3-23 22:08 6 3251
Xilinx+ISE9.1使用全流程中文书.part2 XILINX se part2 0中国芯0 2011-3-23 21:08 4 2464
ModelSim-Altera仿真时出现的问题。 altera 仿真 modelsim swfc_qinmm 2011-3-23 15:51 3 3195
FPGA实验板电路图 FPGA PGA 电路小云001 2011-3-23 15:21 1 1951
将夏宇闻老师教材里一段式状态机改写成三段式，请指正。 ST TE taishan3703 2011-3-23 14:02 3 2853
I2C 的verilog模块中，状态机主要实现什么功能？ verilog sunt8707 2011-3-23 11:59 1 2588
cpld能传输时钟吗，该怎么弄啊？时钟 IO neuhalo 2011-3-23 11:57 5 4497
如何例化元件，是在不会，希望大家帮忙下元件 se ST wangjun403 2011-3-23 11:39 6 2486
DSP2812开发板原理图 DSP 原理图开发板 dianzirobot 2011-3-22 22:34 0 1883
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赛灵思的广电方案分享赛灵思 FPGA PGA mzhang198 2011-3-22 19:05 3 2312
Xilinx FPGA全局时钟和第二全局时钟资源的使用方法 FPGA XILINX 时钟明空 2011-3-22 10:58 8 12170
[verilog] 恭喜赛灵思：全球首个28nm FPGA 产品交付客户 FPGA 赛灵思 TE mzhang198 2011-3-22 10:50 11 3030
Xilinx的数字信号处理解决方案 XILINX 数字信号处理 DSP 奔腾2.0 2011-3-21 22:39 3 2345
[matlab] Xilinx的IP核应该指南 ip核 XILINX ip 小云001 2011-3-21 22:38 8 3202
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