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新手学习官方文档可行吗？quartus之后还需要学习什么？
Quartus ，软件 ，verilog ，quartusII ，模电
FPGA论坛 mathematical 2012-3-20 5 1844 Backkom80 2012-3-22 10:18
紧急help:这个verilog文件xst check syntax报错 attachment
ST ，ck ，verilog ，HDL ，hd
FPGA论坛 edacsoft 2012-3-15 3 2631 GoldSunMonkey 2012-3-15 19:19
请教一个verilog的问题
verilog ，ADDR ，DDR ，se ，address
FPGA论坛 c1apton 2012-3-14 21 2649 GoldSunMonkey 2012-3-16 16:58
请问一下关于distributed memory generator的ip核
Distributed ，generator ，ip核 ，memory ，verilog
FPGA论坛 wwuchang 2012-3-12 6 2910 GoldSunMonkey 2012-3-13 19:42
一套北大verilog课件，不知道坛子里有了没？先放上来。。。 attachment
verilog ，verilo
德州仪器MCU zgsxhzac 2012-3-10 0 1390 zgsxhzac 2012-3-10 22:13
在FPGA/CPLD开讲Verilog HDL语言
verilog ，hdl语言 ，FPGA/CPLD
FPGA论坛 GoldSunMonkey 2012-3-8 13 1729 hihu 2012-3-12 17:17
GSM和大家一起学习Verilog HDL
GSM ，HDL ，verilog ，monkey ，ic
FPGA论坛 GoldSunMonkey 2012-3-8 38 4235 swe21 2012-4-20 17:04
谁能推荐一些优秀的testbench源程序（verilog）？
testbench ，verilog ，源程序 ，测试程序
FPGA论坛 zhushouxi 2012-3-5 24 4833 liedc 2012-4-26 11:42
verilog小数如何表示 attach_img
verilog ，ST ，RS ，Wire ，Input
FPGA论坛 aikimi7 2012-3-1 4 8141 GoldSunMonkey 2012-3-1 15:40
verilog小数如何表示 attach_img
verilog ，ST ，RS ，Wire ，Input
FPGA论坛 aikimi7 2012-3-1 8 4910 Backkom80 2012-3-6 22:54
如何学习FPGA
FPGA ，工程师 ，verilo ，verilog ，软件
ZLG liwsx 2012-2-28 1 1742 www.mjzctea.com 2012-2-28 16:27
verilog菜鸟问题 attach_img
verilog ，verilo ，AC ，数据类型
FPGA论坛 xajun 2012-2-27 2 1534 lining21 2012-2-29 23:08
Quartus II 6.0不能仿真 attachment
Quartus ，仿真 ，verilog ，编写 ，小程序
EDA 技术 SystemNeck 2012-2-23 0 1516 SystemNeck 2012-2-23 17:22
请问各位高手有做过usb2.0 hub 的吗
USB2.0 ，FPGA ，PGA ，verilog ，毕业设计
USB技术专区 huyang1015 2012-2-19 0 2071 huyang1015 2012-2-19 14:11
请教各位前辈有关数字IC的一些问题！！
数字IC ，ic ，verilog ，Verilog语言 ，verilo
新手园地 七尺男儿 2012-2-15 3 1322 caiys 2012-2-16 11:38
请教关于Verilog定义的memory的初始赋值问题
memory ，verilog ，verilo ，存储单元
FPGA论坛 ylanxuez 2012-2-13 8 4348 Backkom80 2012-2-18 12:52
怎么对Verilog定义的memory初始赋值
memory ，verilog ，verilo ，存储单元
FPGA论坛 ylanxuez 2012-2-12 6 7540 beck_ck 2012-2-24 12:35
有谁知道DXP Altinm里面有一些关于FPGA的那些功能怎么用？
dxp ，FPGA ，TI ，HDL ，verilog
FPGA论坛 jakfens 2012-1-31 7 1611 ertu 2012-2-1 15:57
基于Verilog HDL的UART模块设计与仿真
模块设计 ，HDL ，仿真 ，verilog ，UART
ZLG msp430ing 2012-1-18 6 2196 lifenganhui 2012-2-1 15:59
求助：inout端口在test文件里面作为输入怎么用
inout ，端口 ，TEST ，sd ，verilog
FPGA论坛 梦境缠绕 2012-3-14 3 1485 Backkom80 2012-3-15 12:45
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