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利用PCI局部总线实现BIade Server的数据交换
2012-7-11 17:36 3 1588
再次请教fifo的问题
2012-7-11 00:17 11 2227
有谁用WINCUPL?刚学,请教如何生成JED
2012-7-10 22:08 2 2684
那有谁知道CCITT-CRC16的反转算法,串行的电路是怎样的?
2012-7-10 22:07 2 2109
XILINX_FPGA设计中如何更好的优化资源 attachment
2012-7-10 22:02 2 1832
FPGA设计指导准则 attachment
2012-7-10 22:00 1 1682
基于FPGA的数字滤波系统设计 attachment
2012-7-10 18:32 2 1481
在CPLD管理下实现高效多串口中断源
2012-7-10 13:54 1 1614
xilinx开发板申请
2012-7-10 00:16 4 2482
关于信号延迟问题 attach_img
2012-7-9 22:12 6 2584
寻高手带下fpga,希望到深圳
2012-7-9 21:45 9 2377
[matlab] EDK官方实验 attachment
2012-7-9 21:39 7 2619
[matlab] 急!用VHDL做PCI管理编程 attachment  ...2
2012-7-9 21:38 33 5143
[matlab] 用CORE Generator产生PCIe Endpoint时到33%停止不动
2012-7-9 21:37 4 2763
[matlab] 生成的ip核如何编写驱动函数,怎样使用?
2012-7-9 20:58 8 2970
FPGA与DSP的高速通信接口设计与实现(回复给分) attachment  ...2
2012-7-9 18:55 20 3477
那有谁知道CCITT-CRC16的反转算法,串行的电路是怎样的?
2012-7-9 14:47 2 1902
FIFO读写规则
2012-7-9 14:33 2 2414
[CPLD] 利用FPGA实现异步FIFO设计
2012-7-9 12:50 0 2169
FIR数字滤波器分布式算法的原理及FPGA实现
2012-7-9 12:47 0 1654
Xilinx 的 FIR 核 .coe文件的载入
2012-7-9 12:45 0 2560
fpga如何向fifo里面写一个字节?
2012-7-9 12:33 9 2465
Xilinx FPGA芯片底层单元的使用 attachment
2012-7-9 12:32 4 1939
fpga的疑问???
2012-7-7 19:48 8 1870
基于FPGA的DDS设计 attachment
2012-7-7 13:48 4 2129
X-FEST登陆北京
2012-7-6 22:42 8 2329
一个关于延迟检测的问题  ...2
2012-7-6 22:35 28 4457
active和modelsim
2012-7-6 21:45 4 1795
X-FEST登陆北京 attach_img agree  ...2
2012-7-6 21:41 26 4164
输入输出为什么加FF  ...2
2012-7-6 21:39 31 4812
适用于Xilinx FPGA的模拟器件解决方案指南 attachment
2012-7-6 21:20 2 1735
《原创》 DCM简介 attach_img agree
2012-7-5 23:11 14 4047
FPGA内部结构 attachment
2012-7-5 23:11 3 1854
有没有人用过ISE里或者xps里面的datamover核,求用法?
2012-7-5 22:18 2 2431
EDA技术基础 attachment agree
2012-7-5 20:32 13 1936
使用EMIF将Xilinx FPGA与TI DSP平台接口
2012-7-5 20:19 1 1312
对Xilinx FPGA 中FIFO的仿真
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2012-7-5 19:42 20 3517
FPGA实现DSP attachment
2012-7-5 19:40 9 1964
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