今日: 0|主题: 14200|帖子: 104294 收藏 (179)
说说赛灵思(Xilinx )的FPGA 高速串行收发器
2012-10-20 13:46 1 1416
[matlab] modelsim仿真xilinx IP DCM 实例
2012-10-20 13:28 2 1970
赛灵思 FPGA的配置与JTAG
2012-10-20 13:24 3 1848
[VHDL] 视频图像灰度信号直方图均衡的FPGA实现
2012-10-19 23:46 2 1755
[modelsim] 基于多相滤波的数字接收机的FPGA实现
2012-10-19 23:24 1 1799
赛灵思加速驾驶员辅助系统开发
2012-10-19 22:43 2 1431
[FPGA] spartan-6 microboard lx9开发板参考设资料
2012-10-19 21:37 3 2226
简易频谱分析仪
2012-10-19 18:17 2 3950
赛灵思推出ARM汽车级平台,加速汽车驾驶员辅助系统部署 attach_img
2012-10-19 15:20 0 1832
用FPGA实现MAC核所要完成的功能 attach_img
2012-10-19 14:45 1 2523
cygwin 显示中文
2012-10-19 13:11 2 2067
[modelsim] 请问差分时钟输入时序约束怎么做的?
2012-10-19 13:06 2 3144
Modelsim用PLI的方法
2012-10-18 22:55 1 1711
[CPLD] 关于FIFO的IP核的使用
2012-10-18 22:07 0 2062
Verilog PLI 应用举例
2012-10-18 21:52 1 1708
如何Dump波形文件并显示波形
2012-10-18 21:43 1 2022
[verilog] Zynq-7000 SoC平台能够给驾驶员辅助系统开发人员带来更多优势
2012-10-18 21:21 0 1544
赛灵思推出基于ARM®处理器的汽车级平台
2012-10-18 21:18 0 1288
candence文档查阅方式
2012-10-18 21:15 0 1159
VerilogHDL仿真中的宏定义方式
2012-10-18 21:12 0 1397
如何在shell脚本中调用Matlab
2012-10-18 21:12 0 1237
[matlab] EDK学习总结--XGPIO2
2012-10-18 21:08 0 1297
[matlab] EDK学习总结---XGPIO 1
2012-10-18 21:08 0 1534
光纤通信方案求助  ...2
2012-10-18 20:05 20 3741
verilog开发经验。
2012-10-18 16:57 11 1795
使用cadence和mentor的朋友请注意了!
2012-10-18 16:56 4 2070
防止FPGA设计中综合后的信号被优化
2012-10-18 16:56 3 3876
[VHDL] ddr2与virtex 5 的连接
2012-10-18 14:35 4 2102
赛灵思加速驾驶员辅助系统开发(ZT)
2012-10-18 14:07 0 1357
[matlab] 算法级综合器,就是牛X!(妈妈说,标题要长~~~~~~~~~~~~)
2012-10-18 13:06 8 1973
求ise 13.2下载地址
2012-10-17 21:24 1 4065
RTL级与行为级
2012-10-17 21:09 5 2072
ZED zynq 板子到了,启动信息如下
2012-10-17 21:08 1 1466
硬件描述语言VHDL
2012-10-17 21:08 14 2367
[verilog] 看到了一个Zynq基本系统
2012-10-17 21:00 0 2149
FPGA开发软件问题 详解
2012-10-17 20:58 4 1817
关于NETFPGA-10G敬告国内朋友
2012-10-17 20:56 0 2176
FPGA在线加载模式简介
2012-10-17 20:54 1 1830
HDMI 转换与传输
2012-10-17 20:45 2 1752
RocketIO及其在高速数据传输中的应用
2012-10-17 20:39 3 1534
下一页 »
快速发帖
还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则