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高速电路板设计技术 attachment agree
2012-10-26 22:58 15 3161
xilinx的14.2版,用了一段时间总结 agree  ...2
2012-10-26 22:49 32 8622
ecos-SD卡驱动程序设计
2012-10-26 22:48 3 1956
ISE11.x中Modelsim仿真库的编译步骤
2012-10-26 22:47 5 2134
Xilinx FPGA学习资料汇总
2012-10-26 22:42 4 4173
基于System Generator的FPGA开发总结
2012-10-26 22:41 5 2259
请问epm7128与7256兼容性问题
2012-10-26 11:20 0 1313
求助,verilog中多个模块的引用
2012-10-26 08:45 6 2987
基于FPGA的Σ-∆ 转换中抽样滤波器的设计
2012-10-25 17:37 5 2652
ISE12.1抢先使用感受
2012-10-25 17:35 2 1475
对FPGA在电机控制系统中作用的思考
2012-10-25 17:34 1 1935
quartus2中,这个warning 如何消除
2012-10-25 17:10 10 2746
程序中多个实钟带来的问题分享给大家,警醒后来者
2012-10-25 17:08 5 1548
关于sram的讨论
2012-10-25 17:06 8 1948
system generator硬件协同仿真时序不收敛的简单解决办法
2012-10-25 17:06 6 2862
ip核的问题
2012-10-24 23:37 7 2252
Atlys开发板FPGA Design Flow LAB3的KPSM3程序
2012-10-24 23:33 2 2009
Atlys开发板FPGA Design Flow LAB4的KPSM3程序
2012-10-24 23:33 1 2120
Atlys开发板FPGA Design Flow LAB5的KPSM3程序
2012-10-24 23:33 1 1717
赛灵思 FY13 Q2: 28nm产品销售超2000万美元(ZT)
2012-10-24 16:52 2 1362
FPGA与CPLD有啥区别?哪个更适合用在电机控制中?
2012-10-24 16:39 9 3714
在FPGA开发中尽量避免全局复位的使用?(1)
2012-10-24 16:23 6 1803
SPARTAN6的DDR2中soft Calibration??
2012-10-24 13:18 5 1876
一个简单功能,如何VHDL实现?  ...2
2012-10-24 12:54 22 3893
SPARTAN6中的软校准-第二问 ?
2012-10-24 12:51 5 1599
[VHDL] 基于XilinxFPGA的高速Viterbi回溯译码器 attachment
2012-10-24 12:21 1 1903
ISE与EDK联合开发流程
2012-10-24 12:20 16 4617
[CPLD] 基于XilinxFPGAIP核的FFT算法 attachment
2012-10-24 12:20 2 1681
[matlab] 用ISE原理图编辑问题 attach_img
2012-10-24 12:04 7 2931
ep3c的PLL1_CLKOUTn脚可以做普通的io吗?
2012-10-24 08:40 6 2749
[CPLD] 基于Xilinx_PicoBlaze软核的数字频率计的设计与实现 attachment
2012-10-23 23:57 1 1473
今天解决了一个很基础的问题
2012-10-23 23:52 3 1766
[CPLD] XilinxFPGA上电时序分析与设计 attachment
2012-10-23 23:29 0 1874
[CPLD] 使用Xilinx的Spartan_6FPGA作DDR芯片测试 attachment
2012-10-23 23:12 0 1431
在FPGA开发中尽量避免全局复位的使用?(3) agree
2012-10-23 22:03 3 1772
[CPLD] XilinxSRAM型FPGA抗辐射设计技术研究 attachment
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在FPGA开发中尽量避免全局复位的使用?(5)
2012-10-23 22:02 3 1648
在windows 7安装xilinx usb cable成功
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时序的几个概念 attachment agree
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RADX、Xilinx和ADI联合演示先进的可编程EdgeQAM技术方案
2012-10-23 22:01 3 1862
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