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[CPLD] 基于CPLD的水下冲击波记录仪的设计
2012-8-8 18:57 2 1466
CH372可以直接连FPGA吗?
2012-8-8 18:13 4 2042
赛灵思CTO:摩尔定律的精髓在于创造新价值(ZT)
2012-8-8 14:28 0 1748
ALTERA DDR2内核编译遇到的问题
2012-8-8 14:15 2 3750
用fpga做图像处理 是FPGA重要还是图像处理的算法重要
2012-8-7 23:18 8 3677
[matlab] 新手求助,vhd文件打不开
2012-8-7 23:16 7 3057
[CPLD] Xilinx FPGA设计时序约束指南  ...2
2012-8-7 18:53 20 3713
textio可以随机读取吗?
2012-8-7 16:46 5 1358
求助。这个电容太奇怪了 attach_img
2012-8-7 10:56 0 1120
Xilinx ISE 不同机器的编译结果是否一样
2012-8-6 22:55 5 1556
textio可以随机读取数据吗?
2012-8-6 22:34 1 1288
程序突然无法下载了
2012-8-6 22:34 6 2557
接着问一个用ISE设计DDR2控制器的版本问题
2012-8-6 22:33 4 1856
[CPLD] ISE13.1调用Modelsim10.0出现的一点小问题及解决过程 agree
2012-8-6 18:52 5 2288
[Quartus] chipscope 如何抓取很长一段时间波形
2012-8-6 16:13 8 4179
请教版主及各同事:spartan6的MIG做DDR2的控制器
2012-8-6 11:27 3 3275
双端口RAM
2012-8-5 17:54 3 1727
基于FPGA和DSP的高速雷达信号分析、成像信号实时处理板系统
2012-8-5 17:53 5 1774
FPGA/ASIC设计工作者的未来方向
2012-8-4 23:57 0 1707
单纠错和双检错(中文版) attachment
2012-8-4 18:43 4 2043
【请教】PHY的通信故障 attach_img
2012-8-4 18:40 12 3494
大幅降低串行数字接口成本与功耗
2012-8-4 18:37 7 2101
Xilinx FPGA设计进阶(提高篇).zip attachment  ...23
2012-8-4 18:37 45 5609
ip core 中dds 怎么用?
2012-8-4 18:32 13 2766
那位的公司有些小活,要找帮手的说声!
2012-8-4 17:17 1 1178
请问购买了带硬核FPGA芯片仍需要购买IP使用许可吗?
2012-8-4 17:17 1 1917
达拉斯芯片的**?
2012-8-4 17:16 6 3182
[modelsim] Xilinx AccelDSP与System Generator的简单应用
2012-8-4 17:11 8 1995
同步写异步读
2012-8-4 10:57 10 2042
[CPLD] 在不用ISE软件的条件下,如何使用IMPACT软件烧写Prom  ...2
2012-8-3 23:23 30 8469
求教:cpld是否有专门接无源晶振的管脚?
2012-8-3 16:53 4 4464
大话FPGA喽 attachment
2012-8-3 16:16 18 2384
呃 安装了一个ISE13.1 问题来了(发牢骚) attachment  ...23
2012-8-3 07:47 50 5937
[CPLD] FPGA重复配置和测试的实现
2012-8-2 18:47 8 1619
基于FPGA+ARM的高速计算机屏幕信息记录系统
2012-8-2 18:47 5 1447
请教:ddr2内存的dqs信号 attachment
2012-8-2 18:47 15 6030
提高设计性能的 HDL 编码实践 attachment
2012-8-2 18:46 10 1795
FPGA设计中的边沿检测问题 attach_img
2012-8-2 18:43 4 1500
FPGA逻辑设计实验 attachment
2012-8-2 18:42 12 1906
[CPLD] Xilinx FPGA 内部结构深入分析 attachment
2012-8-2 18:42 4 2449
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