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[FPGA] 求推荐fpga +20-50M ad采样 新人帖
2018-2-2 15:28 12 1984
[FPGA] FPGA 三段式状态机 状态改变条件成立,实际状态并未改变...
2018-2-1 10:55 2 1362
[FPGA] AD转换 attach_img
2018-1-30 23:59 3 1076
板子下载失败:The idcode read from the device does not match the idcode  ...2
2018-1-29 22:41 38 16400
[FPGA] AD7606快速采样问题
2018-1-29 17:14 0 1703
[FPGA] 勇敢的芯伴你玩转Altera FPGA连载46:基于仿真的第一个工程... attach_img
2018-1-29 15:05 0 694
[VHDL] 玩转VHDL015-高速信号的比特同步
2018-1-29 12:01 0 1167
在Quratus II 中出现Fast TLB Miss Exception vector memory是什么问题? 新人帖 attach_img
2018-1-28 10:32 2 1819
[FPGA] FGPA DVI TFP401A
2018-1-27 08:47 3 2396
[FPGA] 勇敢的芯伴你玩转Altera FPGA连载基于仿真的第一个工程实例... attach_img
2018-1-26 22:44 0 1098
ZYNQ XC7XXX 硬件原理图和PCB attach_img
2018-1-26 13:05 6 3246
[FPGA] 勇敢的芯伴你玩转AlteraFPGA连载基于仿真的第一个工程... attach_img
2018-1-24 21:27 0 816
[FPGA] 结束
2018-1-24 11:46 3 819
[FPGA] 让FPGA输出400mV至600mV的交流信号
2018-1-23 20:21 4 1240
Avnet Zynq-7000 SoC/AD9361 SDR 系统开发套件介绍 attach_img
2018-1-23 10:04 9 7103
[FPGA] 勇敢的芯伴你玩转Altera FPGA连载43:基于仿真的第一个工程... attach_img
2018-1-22 21:08 0 748
[FPGA] 勇敢的芯伴你玩转Altera FPGA连载42:基于仿真的第一个工程... attach_img
2018-1-21 21:46 0 987
[FPGA] [求助]FPGA+USB_cy7c68013实现 新人帖
2018-1-20 22:39 4 990
FPGA固化 新人帖
2018-1-20 17:37 2 974
[FPGA] 求助!XC3S50AN的可以JTAG调试,但是不能下载到内部flash 新人帖 attach_img
2018-1-20 12:02 10 4233
利用FPGA进行AD转换后进行乘法运算 attach_img
2018-1-17 15:01 1 1347
[Quartus] 波形问题
2018-1-17 14:40 5 1270
[Quartus] quarter ii 10.0是不是只能联合ModelSim一起进行仿真 ?
2018-1-17 14:38 1 1780
[FPGA] 【学习】 FPGA必备知识
2018-1-17 13:58 4 1167
勇敢的芯伴你玩转Altera FPGA连载41:基于仿真的第一个工程... attach_img
2018-1-17 10:05 0 787
[FPGA] 勇敢的芯伴你玩转Altera FPGA连载40:基于仿真的第一个工程... attach_img
2018-1-15 17:49 0 1017
[FPGA] Xinlinx中EDK添加xps_intc中断问题
2018-1-15 11:52 3 1071
[FPGA] Xilinx 在ISE已完成的工程文件中添加IP核 attach_img
2018-1-14 21:13 2 1427
[FPGA] 求教大神!!读EEROM,程序会经常死在无法理解的状态机 新人帖 attach_img
2018-1-14 20:41 8 1702
[FPGA] 新人求请教 新人帖
2018-1-13 12:02 1 738
FPGA三段式状态机里定时任务如何处理
2018-1-10 16:10 0 997
[FPGA] 勇敢的芯伴你玩转Altera FPGA连载38::Verilog代码风格之双向... attach_img
2018-1-9 21:59 2 1256
[FPGA] 勇敢的芯伴你玩转Altera FPGA连载39:Verilog代码风格之提升系... attach_img
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[FPGA] chipscope的条件触发怎么用?
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[matlab] MATLAB 的system generator仿真闪退 attach_img
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[FPGA] zedboard通过FMC连接AD子板后无法扫出zynq芯片 attach_img
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[FPGA] FPGA设计过了几年后才出现的奇怪问题 新人帖
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[CPLD] 请问各位大神,Lattice 的ispMACH LC4512 CPLD烧程序问题?
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[FPGA] 勇敢的芯伴你玩转Altera FPGA连载36:Verilog代码风格之寄存器... attach_img
2018-1-2 19:58 0 1107
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