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mig生成ddr2的ip核时序问题 attach_img
2013-9-23 13:21 5 2443
[FPGA] 技术资料
2013-9-23 12:46 0 1392
单片机自定义数据结构发送问题
2013-9-22 23:15 2 1405
Xilinx在IDF13上展示业界首款FPGA 80Gbps网络接口卡和最新Intel QPI
2013-9-22 23:05 2 2380
[FPGA] ise 13.3里有除法的ip核吗?
2013-9-22 23:01 5 2332
[matlab] 2011年电子设计竞赛XILINX FPGA培训 attachment  ...234
2013-9-22 20:54 74 13448
[CPLD] (求助)cpld给AD芯片max125写时序,我没找到时间参数 attachment
2013-9-22 12:12 10 2115
[Quartus] quartus问题 attach_img
2013-9-22 11:26 16 2903
[FPGA] 怎么用xilinx那个cordic核做对数运算哦? attachment
2013-9-22 09:09 13 3184
Xilinx与生态伙伴启动All Programmable抽象化计划
2013-9-21 19:21 0 2349
测试10
2013-9-21 19:16 0 1719
[FPGA] 如何取通信时钟的最佳周期,来进行通信?
2013-9-21 19:10 10 1693
高校讲学视频第八讲:可编程逻辑器件制造工艺--EDA原理及应
2013-9-21 18:39 2 1926
高校讲学视频第六讲:可编程逻辑器件制造工艺--EDA原理及应
2013-9-21 18:39 3 1641
高校讲学视频第三讲:可编程逻辑器件制造工艺--EDA原理及应
2013-9-21 18:37 2 1557
高校讲学视频第四讲:可编程逻辑器件制造工艺--EDA原理及应 agree
2013-9-21 18:37 3 1847
高校讲学视频第一讲:可编程逻辑器件制造工艺--EDA原理及应 agree
2013-9-21 18:36 3 1742
高校讲学视频第二讲:可编程逻辑器件制造工艺--EDA原理及应
2013-9-21 18:35 3 1576
高校讲学视频第七讲:可编程逻辑器件制造工艺--EDA原理及应
2013-9-21 18:34 1 1404
高校讲学视频第五讲:可编程逻辑器件制造工艺--EDA原理及应 agree
2013-9-21 18:32 2 1226
DVI接口兼容HDMI么?
2013-9-21 10:51 11 2521
视频: 【IPCE2013】基于Zynq/Artix-7的GigE机器视觉方
2013-9-21 10:05 7 2338
谢谢HOERNI先生,不过FIN时代已经来了
2013-9-20 21:04 7 2438
测试9
2013-9-20 19:55 0 905
[FPGA] 分频后时钟建立时间过长为什么???大婶请指教
2013-9-20 19:50 2 1304
视频: 【IPCE 2013】ZING SoM——业界最小Zynq系统模块
2013-9-20 19:48 4 2035
视频: 【中文视频】Virtex-7 GTH 收发器对决 Altera Stratix V GX 收 agree
2013-9-20 19:45 3 2002
视频: 如何使用 Vivado 串行 IO 分析器 agree
2013-9-20 19:44 3 1454
关于Scaler问题
2013-9-20 19:44 15 3189
Altera的FPGA与Micron混合内存立方实现互操作 共同引领业界
2013-9-20 19:44 3 1924
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